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公开(公告)号：CN118041348A
公开(公告)日：2024-05-14
申请号：CN202410125251.6
申请日：2024-01-29
申请人： 西安电子科技大学芜湖研究院 , 西安电子科技大学
摘要： 本发明提供了一种改进的基于非等值尾电流的非线性编码的高线性度相位插值电路，包括：共用一组负载电阻的左右两个差分电路结构，每个差分电路结构内部包括多组差分放大器；每个差分电路结构的输入为一组互补时钟信号；每个差分控制对管受控制码控制，以控制对应的差分放大器或尾电流源导通或关闭，进而插值出相位范围内的离散时钟；所有尾电流源的尾电流局部呈线性，全局呈非线性；控制码的位数与插值个数非线性相关。本发明通过改进两个差分电路结构，从而减少了输入时钟相数，只需要输入四相时钟，就可以达到很高的线性度；并且改进了控制尾电流的编码方式，从而减轻了使用二进制编码在实际电路当中容易发生竞争和冒险所产生的毛刺问题。
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公开(公告)号：CN117459343A
公开(公告)日：2024-01-26
申请号：CN202311346240.2
申请日：2023-10-17
申请人： 西安电子科技大学芜湖研究院 , 西安电子科技大学
IPC分类号： H04L12/40 , H03K5/24 , H03K17/687
摘要： 本发明公开了一种适用于CAN的振铃抑制电路，包括减法器电路、振铃采样电路、振铃采样电路的复位电路以及动态比较器电路及其复位电路；所述减法器电路用于对总线信号做减法，得到纯净的振铃信号；所述振铃采样电路用于将得到的振铃信号进行峰值采样并保存；所述振铃采样电路的复位电路用于控制振铃采样电路的使能与复位功能；所述动态比较器电路及其复位电路用于将振铃采样电路得到的信号与参考电平作比较，进而输出信号控制MOS电阻导通，达到振铃抑制的目的。本发明采用动态比较器，不需要额外的外部控制信号，减少振铃抑制电路对总线的影响。通过振铃采样电路，用较简单的结构就可较好地保持振铃信号的峰值，同时降低了对器件工作频率的要求。
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公开(公告)号：CN117453593A
公开(公告)日：2024-01-26
申请号：CN202311339459.X
申请日：2023-10-17
申请人： 西安电子科技大学芜湖研究院 , 西安电子科技大学
摘要： 本发明公开了一种摆率可调的低电磁辐射CAN总线发送器，包括N个高侧电流开关、N个高侧电流源、N个低侧电流开关和N个低侧电流源；电流源用于提供输出电流，高侧电流开关和低侧电流开关用于控制电流源的导通与关断，电流源的电流由功率管提供；高侧电流开关和低侧电流开关通过移位寄存器控制。本发明利用移位寄存器来控制多级电流开关，通过改变时钟频率来控制每一级电流开关的导通延迟，最终达实现摆率可控。由于移位寄存器的作用，相邻两级电流镜的延时固定，这个特点同时解决了CANH与CANL之间的不匹配问题，减弱了工艺因素对CANH与CANL的匹配度的影响，使CANH与CANL的对称性更好，减小共模不匹配引起的电磁辐射。
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公开(公告)号：CN117348680A
公开(公告)日：2024-01-05
申请号：CN202311344846.2
申请日：2023-10-17
申请人： 西安电子科技大学芜湖研究院 , 西安电子科技大学
摘要： 本发明公开了一种适用于CAN总线的摆率控制电路，包括译码器U0、n个NMOS管、n个阻值为R的电阻和输出端的峰值保持电路U1共同构成了新型电阻阵列；所述峰值保持电路U1的输出端VO与电压跟随器U2的正相输入端相连，电压跟随器U2的反相输入端与输出端相连，并接入MOS器件M0的栅极；密勒电容CM的两端分别接入MOS器件M0的栅极与漏极；负载电容CL的一端连接MOS器件M0的漏极，另一端接地；负载电阻RL的一端接入输出节点VOUT，另一端接地。本发明能够过滤掉过冲电压，保持电阻阵列输出电压的稳定性；在高压功率MOS器件的输出端与输入端串接米勒电容，以稳定MOS器件漏极电流的摆率，进而稳定输出电压的变化速度，达到摆率控制的目的。
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公开(公告)号：CN117234268A
公开(公告)日：2023-12-15
申请号：CN202310979927.3
申请日：2023-08-04
申请人： 西安电子科技大学
IPC分类号： G05F1/56
摘要： 本发明公开了一种快速瞬态响应高电源抑制的无片外电容多环路控制LDO，包括：快环路、慢环路和RC模块；其中，快环路包括：AB类误差放大器A1和功率管MP；快环路嵌套于慢环路中；慢环路包括：AB类误差放大器A1、功率管MP和全差分误差放大器A2；采用AB类误差放大器作为功率管MP的栅极的输入，功率管栅极电容的充放电电流大小会随着AB类误差放大器A1差分输入的大小而变化。故能够实现较高的转换速率，使得LDO的瞬态响应性能提升；采用慢环路控制快环路中AB类误差放大器的电流源。增加的慢环路使得整体电路的PSR性能更依赖于慢环路的全差分误差放大器A2，故能够实现快速瞬态响应的同时，仍然有高电源抑制特性。
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公开(公告)号：CN116633347A
公开(公告)日：2023-08-22
申请号：CN202310602501.6
申请日：2023-05-25
申请人： 西安电子科技大学
摘要： 本发明公开了一种基于非线性鉴相器电路的延迟锁相环电路，涉及时钟信号产生电路技术领域，解决了技术中锁相环电路锁定精度不高，同时混合信号延迟锁相环电路设计复杂，且面积和功耗较大的问题，该电路包括：n个采样器电路、n个串转并电路、信号处理电路以及压控延时链电路；n个采样器电路之间并联，n个串转并电路之间并联，n个采样器电路分别串联n个串转并电路；信号处理电路与n个串转并电路串联，信号处理电路用于输出模拟电压；压控延时链电路与信号处理电路串联，压控延时链电路用于输出反馈信号，并将反馈信号传输至n个采样器电路；实现了在简化电路结构的基础上，提高了产生多相时钟的精度。
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公开(公告)号：CN113422605B
公开(公告)日：2023-08-22
申请号：CN202110763310.9
申请日：2021-07-06
申请人： 西安电子科技大学芜湖研究院
IPC分类号： H03M1/10
摘要： 本发明公开了一种溢出校准电路、模数转换器及模数转换方法，基于流水线型ADC第一子级和第二子级输出的数字码同时进行溢出判断，并将判断的结果传输到校准输出电路进行校准，在发生下溢出的时候将校准输出电路的输出全部置0，在发生上溢出的时候将校准输出电路的输出全部置1，完成溢出判断，并校准输出。如果存在因误差导致的溢出判断比较器判断结果出错，可以在溢出判断电路和校准输出电路校准判断失误的溢出位，保证电路的正常输出。
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公开(公告)号：CN116032267A
公开(公告)日：2023-04-28
申请号：CN202310029271.9
申请日：2023-01-09
申请人： 西安电子科技大学
IPC分类号： H03K17/687 , H03K17/14 , H03K17/16 , H03M1/66
摘要： 本发明公开了一种用于减少电阻型数模转换器开关数量及译码的方法和装置，包括电阻Rz，所述电阻Rz将电源VREFP一分为二后通过2N个单位电阻进行分压，分压后的每个电压连接到右边的NMOS开关的源端，所述NMOS开关的漏端交叉连接至两条电压传输线；开关阵列NMOS管的栅连接数字译码电路产生的开关控制信号，所述开关阵列NMOS由译码电路控制导通还是关断状态。本发明可以实现开关级数最少，译码规模减少，并在版图上可以很好的进行匹配。
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公开(公告)号：CN110348258B
公开(公告)日：2020-11-24
申请号：CN201910628561.9
申请日：2019-07-12
申请人： 西安电子科技大学
摘要： 本发明公开了一种基于机器学习的RFID应答信号帧同步系统，涉及RFID技术领域，其包括：参数训练器，用于根据输入的RFID应答信号，向判决器输出多个权重向量，权重向量用于同步不同频偏区间的RFID应答信号；偏置与幅值计算器，用于根据输入的RFID应答信号和开始信号，向判决器输出偏置、幅值和偏置与幅值有效信号；判决器，输出RFID应答信号所属频偏区间编号和同步有效信号，本发明的有益效果是：利用机器学习的方式训练出的帧同步参数更契合RFID应答信号的信号特征，减弱收发机硬件电路带来的信号畸变的影响，能够精确同步所属频偏区间的应答信号。
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公开(公告)号：CN110348258A
公开(公告)日：2019-10-18
申请号：CN201910628561.9
申请日：2019-07-12
申请人： 西安电子科技大学
摘要： 本发明公开了一种基于机器学习的RFID应答信号帧同步系统，涉及RFID技术领域，其包括：参数训练器，用于根据输入的RFID应答信号，向判决器输出多个权重向量，权重向量用于同步不同频偏区间的RFID应答信号；偏置与幅值计算器，用于根据输入的RFID应答信号和开始信号，向判决器输出偏置、幅值和偏置与幅值有效信号；判决器，输出RFID应答信号所属频偏区间编号和同步有效信号，本发明的有益效果是：利用机器学习的方式训练出的帧同步参数更契合RFID应答信号的信号特征，减弱收发机硬件电路带来的信号畸变的影响，能够精确同步所属频偏区间的应答信号。
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