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公开(公告)号:CN116137528A
公开(公告)日:2023-05-19
申请号:CN202310140251.9
申请日:2023-02-13
申请人: 西安电子科技大学芜湖研究院
IPC分类号: H03K19/173 , H03K19/20 , G06F30/343
摘要: 本发明公开了一种可配置逻辑单元电路及FPGA电路,其中的可配置逻辑单元电路包括:查找表模块、全加器模块和选择器模块;查找表模块包括四个4输入的查找表;全加器模块包括级联的第一全加器和第二全加器,第一全加器与第一查找表和第二查找表的输出端相连接,并接入低位进位;第二全加器与第三查找表和第四查找表的输出端相连接,并输入本位进位;选择器模块包括:第一选择器、第二选择器、第三选择器、第四选择器和第五选择器。本发明中的可配置逻辑单元电路,可实现全加算数模式、4位查找表模式、5位查找表模式以及6位查找表模式的灵活配置。
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公开(公告)号:CN115886760A
公开(公告)日:2023-04-04
申请号:CN202310118274.X
申请日:2023-02-15
申请人: 西安电子科技大学芜湖研究院
IPC分类号: A61B5/021 , G06N3/0464 , G06N3/08 , A61B5/00
摘要: 本发明公开了一种血压数据预测方法、装置、电子设备及可读存储介质,其中的血压数据预测方法包括如下步骤:获取光电容积脉搏波信号并对光电容积脉搏波信号进行滤波处理,以获取第一处理信号;对第一处理信号进行去噪处理,以得到第二处理信号;将第二处理信号输入血压预测模型,得到血压预测数据;血压预测模型为基于串联的残差网络块和频谱‑时间块的深度卷积神经网络。通过执行本发明中的方法,能够仅一路光电容积脉搏波信号得到血压预测数据,操作简单,且精度较高。
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