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公开(公告)号：JP2021089607A
公开(公告)日：2021-06-10
申请号：JP2019219857
申请日：2019-12-04
申请人： キヤノン株式会社
发明人： 小澤 学
摘要： 【課題】検証により改竄が検出されたプログラムの復旧処理を行った後、装置が起動するときにWDTによるリセットが実行されるのを防止する情報処理装置を提供する。 【解決手段】情報処理装置MFP1は、プログラムを実行して制御するメインCPUと、プログラムを検証するサブCPUと、装置の動作中に計時を行い、当該計時のクリア制御が第1所定時間内に行われない場合にリセット信号を出力する第1タイマとサブCPUがプログラムの検証で異常を検知したときに計時を行い、計時のクリア制御が第2所定時間内に行われない場合にリセット信号を出力する第2タイマとを備えたWDT部と、WDT部からのリセット信号に基づいてメインCPU及びサブCPUへのリセット信号を生成するリセット回路とを有する。サブCPUは、プログラムの検証で異常を検知すると第1タイマによる計時を停止させ、第2タイマによる計時を開始させてプログラムの復旧処理を行う。 【選択図】図1
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公开(公告)号：JP2021056956A
公开(公告)日：2021-04-08
申请号：JP2019181963
申请日：2019-10-02
申请人： セイコーエプソン株式会社
IPC分类号： B41J29/38 , B41J29/42 , G06F1/24 , H04N1/00 , G06F9/4401
摘要： 【課題】初期化処理の終了までに要する時間の長期化が課題であった。 【解決手段】UI部と、動作部と、前記UI部と前記動作部とを制御するシングルコアのプロセッサーと、を備え、前記プロセッサーは、電源投入に応じて、前記電源投入から第1起動処理までの一連の初期化処理のうち一部の初期化処理を実行するように前記動作部に指示し、前記電源投入に応じて、予め記憶した第1マルチメディアデータに基づく出力を実行するように前記UI部を制御し、前記動作部による前記初期化処理の終了後であって、前記UI部による前記第1マルチメディアデータに基づく出力の期間に、前記第1起動処理を実行し、前記動作部による前記初期化処理の少なくも一部は、前記第1マルチメディアデータに基づく出力のための初期動作の期間に、前記プロセッサーの関与無く実行される。 【選択図】図2
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4.发明专利
公开(公告)号：KR20210027931A
公开(公告)日：2021-03-11
申请号：KR1020190109010A
申请日：2019-09-03
申请人： 삼성전자주식회사
CPC分类号： G06F1/3203 , H05K5/0286 , G06F1/1635 , G06F1/1658 , G06F1/24 , H04M1/0249
摘要： 본 문서에 개시되는 일 실시예에 따른 전자 장치는 적어도 일면에 개구부를 포함하는 하우징, 상기 하우징의 내부에서 상기 개구부에 인접하게 배치되는 소켓, 상기 개구부를 통해 상기 소켓에 삽입되고 하나 이상의 카드를 거치할 수 있는 트레이, 배터리 및 상기 배터리로부터 제공되는 전력을 제어하는 전력 관리 모듈을 포함하고, 상기 소켓은 상기 전력 관리 모듈과 연결되는 제1 단자를 포함하고, 상기 전원 관리 모듈은 상기 제1 단자를 통해 감지되는 제1 신호를 기반으로, 상기 배터리로부터 상기 전자 장치 내부의 적어도 하나의 소자에 제공되는 전력을 제어할 수 있다. 이 외에도 명세서를 통해 파악되는 다양한 실시예가 가능하다.
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公开(公告)号：JP2021507390A
公开(公告)日：2021-02-22
申请号：JP2020533201
申请日：2018-09-24
发明人： アミタブ メーラ , クリシュナ サイ ベルナチョ
IPC分类号： G06F1/24 , G06F15/78 , G06F15/177
摘要： コンピューティングデバイス(100)は、複数のコア(111〜114)と、コア変換コンポーネント(616)と、コア割当コンポーネント(617)と、を含むプロセッサ(100)を備える。コア変換コンポーネントは、レジスタ(405)のセットを設け、複数のプロセッサコアのコア毎に1つのレジスタが存在する。コア割り当てコンポーネントは、プロセッサの初期化中に、コア割り当てスキームに従って、コア変換コンポーネントのレジスタの各々にコアインデックスを提供するコンポーネントを含む。コアインデックスに基づいて、オペレーティングシステムからのプロセス命令が各コアに転送される。 【選択図】図2
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公开(公告)号：JP2020149638A
公开(公告)日：2020-09-17
申请号：JP2019049131
申请日：2019-03-15
申请人： 株式会社リコー
发明人： 伊藤 光男
IPC分类号： B41J29/38 , G06F9/4401 , G06F1/24
摘要： 【課題】複数のユニットを備える装置において、障害発生時の復旧時間の長時間化を抑制できるようにすること。 【解決手段】複数のユニットを備える装置の再起動を制御する起動制御装置であって、複数のユニットの各々の再起動時間と、システム全体の再起動時間と、複数のユニットの各々の、再起動による障害からの復旧成功率とを記憶する記憶部と、記憶部に記憶されている各情報に基づいて、障害に関連するユニットの単体での再起動について、障害からの復旧時間の期待値を算出する期待値算出部と、期待値算出部によって算出された期待値が、システム全体の再起動時間よりも短い場合、ユニットの単体での再起動を実行し、期待値算出部によって算出された期待値が、システム全体の再起動時間よりも長い場合、システム全体の再起動を実行する再起動実行部とを備える。 【選択図】図2
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公开(公告)号：JP2019523933A
公开(公告)日：2019-08-29
申请号：JP2018563091
申请日：2017-06-01
发明人： イガー・ワイ・ゴフマン
IPC分类号： H02M3/00 , G06F1/24 , G06F1/3296
摘要： 本発明の実施形態は、低電圧バッテリを有する電子デバイスに電力供給するためのシステム、装置、および方法を提供する。実施形態は、ベース、エミッタ、およびコレクタを有するトランジスタと、出力ポート、システム電源端子、および入力ポートを有するマイクロコントローラと、マイクロコントローラの出力ポートから生成され、DC-DC昇圧器のイネーブルピンに結合される第1の信号と、マイクロコントローラの出力ポートから生成され、トランジスタのベースに結合される第2の信号であって、第1の信号の反転バージョンである、第2の信号とを含む回路を含む。トランジスタのエミッタは、グラウンドに結合され、トランジスタのコレクタは、DC-DC昇圧器のイネーブルピンに結合される。多数のさらなる態様が開示される。
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