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    HIERARCHICAL SHARED SEMAPHORE REGISTERS
    1.
    发明申请
    HIERARCHICAL SHARED SEMAPHORE REGISTERS 审中-公开
    分层分析仪

    公开(公告)号：US20100115236A1

    公开(公告)日：2010-05-06

    申请号：US12263305

    申请日：2008-10-31

    申请人： Abdulla Bataineh ,  James Robert Kohn ,  Eric P. Lundberg ,  Timothy J. Johnson ,  Thomas L. Court ,  Gregory J. Faanes ,  Steven L. Scott

    发明人： Abdulla Bataineh ,  James Robert Kohn ,  Eric P. Lundberg ,  Timothy J. Johnson ,  Thomas L. Court ,  Gregory J. Faanes ,  Steven L. Scott

    IPC分类号： G06F15/76 ,  G06F9/06

    CPC分类号： G06F9/30101 ,  G06F9/52

    摘要： A multiprocessor computer system having a plurality of processing elements comprises one or more core-level hierarchical shared semaphore registers, wherein each core-level hierarchical shared semaphore register is coupled to a different processor core. Each hierarchical shared semaphore register is writable to each of a plurality of streams executing on the coupled processor core. One or more chip-level hierarchical shared semaphore registers are also coupled to plurality of processor cores, each chip-level hierarchical shared semaphore register writable to each of the plurality of processor cores.

    摘要翻译： 具有多个处理元件的多处理器计算机系统包括一个或多个核心级别分层共享信号量寄存器，其中每个核心级别分层共享信号量寄存器耦合到不同的处理器核心。 每个分层共享信号量寄存器对于在耦合的处理器核上执行的多个流中的每一个是可写的。 一个或多个芯片级别分层共享信号量寄存器也耦合到多个处理器核，每个芯片级分级共享信号量寄存器可写入多个处理器核心中的每一个。