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公开(公告)号：CN105427795A
公开(公告)日：2016-03-23
申请号：CN201610015162.1
申请日：2016-01-11
申请人： 京东方科技集团股份有限公司
IPC分类号： G09G3/32
摘要： 本发明公开了一种像素驱动电路、方法、像素结构及显示器件，该像素驱动电路，用于驱动像素结构中的发光器件，包括：驱动晶体管，源极与发光器件连接；电容结构，第一端和所述驱动晶体管的栅极连接；第一写入控制单元，用于在写入阶段将所述驱动晶体管的阈值电压写入所述电容结构的第一端；第二写入控制单元，用于在写入阶段将数据信号写入所述电容结构的第二端；电源输出控制单元，用于在发光阶段输出电源信号到所述驱动晶体管的漏极；电压跟随控制单元，用于通过所述电容结构控制所述驱动晶体管的栅极的电压跟随所述驱动晶体管的源极的电压的变化。本发明消除了发光器件本身的电容特性对显示的影响。
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公开(公告)号：CN105185349A
公开(公告)日：2015-12-23
申请号：CN201510744515.7
申请日：2015-11-04
申请人： 京东方科技集团股份有限公司
CPC分类号： G09G3/2092 , G09G3/3266 , G09G3/3677 , G09G2310/0286 , G09G2310/0289 , G09G2310/08 , G11C19/28
摘要： 本发明公开了一种移位寄存器、栅极集成驱动电路及显示装置，包括：输入模块，第一复位模块，输出模块，第一下拉控制模块，以及第二下拉控制模块。其中，输入模块用于控制第一节点的电位为第一电位；输出模块用于将时钟信号端的时钟信号提供给信号输出端；第一复位模块用于将参考信号端的参考信号提供给第一节点；第一节点控制信号端和第二节点控制信号端交替输入节点控制信号，使第一下拉控制模块和第二下拉控制模块交替工作，将参考信号端的参考信号分别提供给第一节点和信号输出端，降低了各下拉控制模块的偏置电压的占空比，从而延长了移位寄存器的工作寿命。
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公开(公告)号：CN103236245B
公开(公告)日：2015-08-19
申请号：CN201310151652.0
申请日：2013-04-27
申请人： 京东方科技集团股份有限公司
发明人： 商广良
CPC分类号： G09G3/36 , G09G2310/0286 , G11C19/28
摘要： 本发明实施例公开了一种移位寄存器单元、移位寄存器、和显示装置，涉及显示领域，能够明显提高移位寄存器单元的响应速度，降低功耗，并且提高移位寄存器单元的工作可靠性。该移位寄存器单元包括多个放电开关管，所述放电开关管的一端连接低电平输入端，在放电信号控制下，用于拉低另一端的高电平，至少一个所述放电开关管为双栅开关管。
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公开(公告)号：CN104409513A
公开(公告)日：2015-03-11
申请号：CN201410635863.6
申请日：2014-11-05
申请人： 京东方科技集团股份有限公司
发明人： 商广良
IPC分类号： H01L29/786 , H01L29/10 , H01L21/34 , H01L27/12
CPC分类号： H01L29/78696 , H01L27/12 , H01L29/66742 , H01L29/66969 , H01L29/786 , H01L29/7869 , H01L27/1214
摘要： 本发明公开了一种金属氧化物薄膜晶体管及其制备方法、阵列基板，以解决现有结构的金属氧化物薄膜晶体管在工作过程中电流不稳定，容易产生大电流使得金属氧化物薄膜晶体管无法被关断的问题。所述金属氧化物薄膜晶体管，包括衬底基板，形成于所述衬底基板上相互接触的、且位于不同层的有源层和源漏极金属层，所述源漏极金属层包括分隔开的源电极和漏电极；所述有源层在位于所述源电极和所述漏电极之间的沟道区域具有镂空结构。该镂空结构的所述有源层使得通过的电流平稳，不会产生导致薄膜晶体管无法被关断的大电流。
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公开(公告)号：CN102455552B
公开(公告)日：2015-02-18
申请号：CN201010518930.8
申请日：2010-10-19
申请人： 京东方科技集团股份有限公司
发明人： 商广良
IPC分类号： G02F1/1362 , G02F1/133
CPC分类号： G09G3/3648 , G09G3/3614 , G09G2300/0426 , G09G2310/0205 , G09G2330/021
摘要： 本发明提供一种液晶显示器，包括：阵列基板，所述阵列基板上形成有栅线、数据线和像素电极；同列的第奇数行像素电极连接在该列两侧的数据线中的一条，第偶数行像素电极连接在该列两侧的数据线中的另一条；同行的像素电极分别由位于该行像素电极两侧的两条栅线中的一条控制，每条栅线控制的像素电极位于同一行；相邻两行像素电极之间有两条栅线；两条相邻数据线之间的两个同行且相邻的像素电极分别由该行像素电极两侧的两条栅线中的一条控制，并且分别连接两条相邻数据线中的一条。本发明能够解决现有技术中液晶显示器功耗大的问题。
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公开(公告)号：CN104267329A
公开(公告)日：2015-01-07
申请号：CN201410563203.1
申请日：2014-10-21
申请人： 京东方科技集团股份有限公司
IPC分类号： G01R31/26
CPC分类号： G01R31/2621 , G01R31/2608 , H01L22/34
摘要： 公开了一种晶体管测试电路以及相应的测试方法。该晶体管测试电路用于测试一组晶体管，其中该组晶体管包括至少两个晶体管，所述晶体管测试电路包括：第一电源电压端，连接到各个晶体管的第一极；第一控制信号端，连接到各个晶体管的控制极；以及一组测试端子，包括至少两个测试端子，其中，各个测试端子分别连接到各个晶体管的第二极。根据本发明公开的晶体管测试电路，可以同时测试多个晶体管的偏置电压特性。此外，还可以分别测试各个晶体管的电流特性，避免了对多个晶体管逐一测试偏置电压特性，从而减少了等待时间，提高了测试效率。
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公开(公告)号：CN102708818A
公开(公告)日：2012-10-03
申请号：CN201210123468.0
申请日：2012-04-24
申请人： 京东方科技集团股份有限公司
IPC分类号： G09G3/36
CPC分类号： G11C19/184 , G09G3/20 , G09G3/3266 , G09G3/3688 , G09G2310/0283 , G09G2310/0286 , G09G2310/061 , G09G2320/0223 , G11C19/28
摘要： 本发明提供了一种移位寄存器和显示器，用以解决现有移位寄存器只能实现正向扫描驱动、不能实现双向扫描驱动的问题。该移位寄存器包括：第一薄膜晶体管、第二薄膜晶体管、复位单元和上拉单元。上述移位寄存器和显示器可以实现双向扫描驱动。
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公开(公告)号：CN102655599A
公开(公告)日：2012-09-05
申请号：CN201210002223.2
申请日：2012-01-05
申请人： 京东方科技集团股份有限公司
CPC分类号： G09G3/3611 , G09G5/10 , G09G2310/0243 , G09G2340/0435 , H04N13/359 , H04N13/398
摘要： 本发明实施例提供一种图像显示设备及图像显示方法，涉及显示设备领域，能够在显示设备驱动时，增加充电时间和减低驱动数据切换频率。图像显示方法用于驱动显示设备，显示设备包括m列、n行组合像素，每个组合像素包括第一行子像素，以及位于第一行子像素下方、与第一行子像素一起构成组合像素的第二行子像素，第一栅极引线连接第一行子像素，第二栅极引线连接第二行子像素，包括2D图像模式驱动时，各行组合像素的第一行子像素和第二行子像素都接收显示数据；3D图像模式驱动时，各行组合像素中一行子像素接收数据，各行组合像素中另一行子像素不接收数据。本发明实施例用于图像显示设备的驱动。
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公开(公告)号：CN118553193A
公开(公告)日：2024-08-27
申请号：CN202410823127.7
申请日：2024-06-24
申请人： 京东方科技集团股份有限公司 , 成都京东方光电科技有限公司
IPC分类号： G09G3/32
摘要： 本申请涉及显示技术领域，公开了一种像素驱动电路、显示装置及驱动方法，该像素驱动电路包括：阈值补偿子电路将参考电压提供给第一栅极，导通控制子电路将驱动晶体管的第二栅极与第一极连通，第一补偿电容的第一端与第一栅极耦接，第一补偿电容的第二端与第一极耦接，数据写入子电路将数据电压提供给第二栅极，第二补偿电容的第一端与第二栅极耦接，第二补偿电容的第二端与设定节点耦接，发光控制子电路将驱动晶体管产生的驱动电流提供给发光器件，阈值补偿子电路获取到了阈值电压为零时第一栅极和第一极之间的电压差，第一补偿电容通过保存电压差使阈值电压能维持零值，在生成驱动电流的过程中阈值电压的影响得以消除，提升了画面的显示效果。
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公开(公告)号：CN118401886A
公开(公告)日：2024-07-26
申请号：CN202280004609.9
申请日：2022-11-24
申请人： 京东方科技集团股份有限公司
IPC分类号： G02F1/133 , G09G3/3266
摘要： 一种显示面板、显示装置及其驱动方法，包括：多条栅线(GA)；多个位移寄存单元(120)；其中，多个位移寄存单元(120)中的目标移位寄存单元(121a，121b，122a，122b)包括：帧触发选择电路(12121a，12122a，12123a，12124a)及栅极驱动电路(1211a，1211b)；帧触发选择电路(12121a，12122a，12123a，12124a，12221a，12222a，12223a，12224a)分别与帧触发输入端及N个级联组(GL1_1a，GL1_2a，GL1_3a，GL1_4a，GL2_1a，GL2_2a，GL2_3a，GL2_4a)对应的帧起始信号端(STV1_1a，STV1_2a，STV1_3a，STV1_4a，STV2_1a，STV2_2a，STV2_3a，STV2_4a)耦接；帧触发选择电路(12121a，12122a，12123a，12124a，12221a，12222a，12223a，12224a)用于响应于N个导通信号中且与多个级联组(GL1_1a，GL1_2a，GL1_3a，GL1_4a，GL2_1a，GL2_2a，GL2_3a，GL2_4a)中的第n个级联组对应的第n个导通信号，将输入到帧触发输入端的起始信号输出给第n个级联组(GL1_1a，GL1_2a，GL1_3a，GL1_4a，GL2_1a，GL2_2a，GL2_3a，GL2_4a)对应的帧起始信号端(STV1_1a，STV1_2a，STV1_3a，STV1_4a，STV2_1a，STV2_2a，STV2_3a，STV2_a)；1≤n≤N，n为整数；第n个级联组(GL1_1a，GL1_2a，GL1_3a，GL1_4a，GL2_1a，GL2_2a，GL2_3a，GL2_4a)用于在对应的帧起始信号端(STV1_1a，STV1_2a，STV1_3a，STV1_4a，STV2_1a，STV2_2a，STV2_3a，STV2_4a)接收到起始信号后，对耦接的栅线(GA)进行逐行扫描。
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