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公开(公告)号：CN107040486A
公开(公告)日：2017-08-11
申请号：CN201710190066.5
申请日：2017-03-28
Applicant: 西安电子科技大学
IPC: H04L27/227 , H04L27/233 , H04L27/38 , H04L25/02
Abstract: 本发明提出了一种任意码速率自适应的QPSK解调系统及方法，用于解决现有多档码速率自适应解调系统适应性差以及现有解调方法采样率利用率低的技术问题；系统包括数据采集模块、最佳采样率选择模块、滤波系数生成模块、自适应Costas环模块、重采样模块和位同步判决输出模块，数据采集模块和最佳采样率选择模块形成闭环结构；实现方法包括：以最高采样速率采样模拟调制信号得到高速数字信号；估计该高速数字信号的码速率；计算最佳采样频率；以最佳采样频率采样模拟调制信号得到低速数字信号；对该低速数字信号进行数字下变频和低通滤波；对滤波后信号进行整数倍抽取；对抽取后信号进行位同步，最后判决输出得到原始码元。
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公开(公告)号：CN106385253A
公开(公告)日：2017-02-08
申请号：CN201610808913.5
申请日：2016-09-08
Applicant: 西安电子科技大学
IPC: H03L7/18
CPC classification number: H03L7/18
Abstract: 本发明提出了一种基于参数处理模块和锁相环级联的数字时间转换系统，用于解决现有数字时间转换系统存在的适用范围窄的技术问题，包括参数处理模块(1)、时基产生模块(2)、使能控制模块(3)和数字时间转换模块(4)；参数处理模块(1)从输入设置参数中提取四个控制参数并输出，时基产生模块(2)内部设置有两个锁相环级联结构，产生受输入设置参数调整且具有固定频差的两个时基信号，使能控制模块(3)根据两个时基信号产生并输出使能信号，时间转换模块时基信号产生时间间隔信号。本发明的输出时间间隔分辨率可调整，且资源利用率高，可用于时频测量等领域。(4)根据计数控制字在使能信号控制下利用两个
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公开(公告)号：CN106357154A
公开(公告)日：2017-01-25
申请号：CN201610808682.8
申请日：2016-09-08
Applicant: 西安电子科技大学
IPC: H02N2/18
CPC classification number: H02N2/188
Abstract: 本发明提出了一种多臂耦合型碰撞式压电能量收集装置，用于解决现有压电能量收集装置存在的能量收集效率低的技术问题，包括：外框、压电振子、第一基座、单摆结构、第一磁体和第二磁体，压电振子至少包括平行排列的第一压电振子和第二压电振子，其底端被固定在第一基座上，谐振时可以发生较强的相互耦合；单摆结构包括第二基座、连杆、摆杆和撞击球，连杆的底端固定在第二基座上，其顶端与摆杆的上端活动连接，撞击球固定在摆杆的下端，撞击球摆动时能够与第一压电振子或第二压电振子的自由端相撞；外框的底面固定有第一基座和第二基座，其靠近单摆结构的一侧固定有第一磁体，靠近压电振子的顶部固定有第二磁体。本发明有效地提高了能量收集效率。
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公开(公告)号：CN105301344A
公开(公告)日：2016-02-03
申请号：CN201510617154.X
申请日：2015-09-24
IPC: G01R19/25
Abstract: 基于驱动梁阵列的石英谐振式直流电压传感器芯片，包括传感器本体，传感器本体中部开设有矩形通槽；设置于矩形通槽内的2组驱动梁阵列，驱动梁阵列包括多根驱动梁及连接驱动梁的连接部，连接部相对的端部设置有音叉基座；设置于音叉基座上的音叉，音叉包括一对安装部和连接安装部的振梁，安装部与音叉基座相连；设置于传感器本体上的一对输入电极，每一输入电极包括电极焊盘及连接电极焊盘的金属引线，电极焊盘与驱动梁的固定端相连；设置于传感器本体下方的底座，底座上设置有大小与矩形通槽相适应的凹槽。本发明利用电热膨胀效应和逆压电效应，以驱动梁阵列膨胀产生的位移改变石英音叉的谐振频率，具有准数字信号输出、体积小、易于集成的特点。
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公开(公告)号：CN105159850A
公开(公告)日：2015-12-16
申请号：CN201510475476.5
申请日：2015-08-05
Applicant: 西安电子科技大学
IPC: G06F13/12
CPC classification number: G06F13/124 , G06F2213/0024
Abstract: 本发明公开了一种基于FPGA的多通道数据传输系统，主要解决现有技术传输速率低、结构复杂的问题。其包括：数据转接模块(1)和数据传输控制模块(2)。数据转接模块(1)接收系统外部设备输入的四通道数据，并将数据进行通道标识和组包，合并成前端一通道数据发送到数据传输控制模块(2)；数据传输控制模块(2)将接收到的前端一通道数据拆包、去标识，得到四通道数据后存储下来，用于继续进行数据传输或直接进行数据处理。本发明结构简单，有助于实现多通道数据传输系统的高速率、长距离传输，可用于运动目标的检测及遥感遥测。
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Patent Agency Ranking
公开(公告)号：CN103186097A
公开(公告)日：2013-07-03
申请号：CN201310102727.6
申请日：2013-03-27
Applicant: 西安电子科技大学
Abstract: 本发明提供了一种高分辨率的短时间间隔测量装置，主要解决直接计数法中测量分辨率受限于参考时钟频率的问题。该测量装置包括开始游标延迟链、结束游标延迟链、触发器单元及数据采集与传输模块，其中开始游标延迟链、结束游标延迟链均由路径延时单元和桥接单元级联组成。输入的开始信号Start、结束信号Stop分别经过路径延时单元、桥接单元的延时后进入触发器单元，触发器单元对延时后的Start、Stop信号进行边沿重合检测，通过检测结果中低电平跳变为高电平的位置得出时间间隔测量值，并通过数据采集与传输模块输出。本发明具有测量分辨率高、全数字化、性价比高、抗干扰性强的优点，可用于通信网络、卫星定位中的时间间隔测量。
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公开(公告)号：CN103092060A
公开(公告)日：2013-05-08
申请号：CN201310050621.6
申请日：2013-02-08
Applicant: 西安电子科技大学
Abstract: 本发明公开了一种基于FPGA的时间间隔测量系统与测量方法，主要解决现有技术测量分辨率低，测量误差大的问题。该时间间隔测量系统包括：闸门信号产生模块（1）、时钟管理模块（2）、时间间隔测量模块（3）、数据处理模块（4）、数据输出模块（5）和计算机（6）。闸门信号产生模块（1）将时间间隔信号转换为闸门信号并输出到时间间隔测量模块（3）；时间间隔测量模块（3）对闸门信号进行延迟后进行测量，并将测量数据输出到数据处理模块（4）；数据处理模块（4）将测量数据组成数据帧后输出到数据输出模块（5）；数据输出模块（5）将数据帧输出到计算机（6）计算出待测时间间隔。本发明有效地提高了测量分辨率，降低了测量误差，且实现简单，可用于高分辨率的时间间隔测量领域。
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公开(公告)号：CN101567689B
公开(公告)日：2013-01-23
申请号：CN200910021854.7
申请日：2009-04-03
Applicant: 西安电子科技大学
Abstract: 本发明涉及一种锁相环，特别是一种基于等效鉴相频率的锁相环，其特征是，它至少包括：被测信号分频器和参考信号分频器：用于分别对被测信号和参考信号分频，使分频得到的被测信号和参考信号的等效鉴相频率为5MHz；鉴相处理模块，完成被测信号经分频器后的信号和参考信号经分频器后的信号的鉴相，输出产生控制压控振荡器的控制电压；压控振荡器，用于所述控制电压输的振荡信号。所述的被测信号分频器和参考信号分频器分频值是由外部的单片机控制的，单片机将需要的分频值以8位数据的形式输入到分频器内。所述的压控振荡器为5MHz的压控晶体振荡器，输入端与放大整形模块输出端电连接，输出端与被测信号分频器输入端电连接。
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公开(公告)号：CN101976036A
公开(公告)日：2011-02-16
申请号：CN201010243499.0
申请日：2010-07-30
Applicant: 西安电子科技大学
IPC: G04F10/00
Abstract: 本发明公开了一种短时间间隔测量电路，在Xilinx FPGA器件中实现，包括N(例如N＝100)个D触发器，两条由专用可编程输入输出延迟单元(IODELAY)构成的延迟链，短时间间隔开始信号Start和短时间间隔结束信号Stop。本发明还提供了一种短时间间隔测量方法，包括：调节短时间间隔测量电路中两条IODELAY延迟链的延迟tap值，使两条延迟链的各级延迟单元具有均匀的延迟，同时使得两条延迟链的每一级延迟单元都具有稳定的延迟差。因为本发明中采用的是IODELAY延迟链结构，可以实现更高精度的时间间隔测量；结构简单，节省成本；开发周期短，便于升级和更新。
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公开(公告)号：CN115081475B
公开(公告)日：2025-04-15
申请号：CN202210652879.2
申请日：2022-06-08
Applicant: 西安电子科技大学
IPC: G06F18/24 , G06F18/213 , G06F18/214 , G06N3/0464 , G06N3/0455
Abstract: 本发明提出了一种基于Transformer网络的干扰信号识别方法，主要解决现有方法对干扰信号进行特征提取的过程复杂、难度大且提取不完全的技术问题。方案包括：1)仿真通信信号数据和干扰信号数据，构建单一干扰和复合干扰数据集，并进行划分和标签标注；2)构建局部特征提取模块；3)构建全局特征融合模块；4)构建基于局部特征提取模块和全局特征融合模块的干扰识别网络；5)使用构建的数据集对干扰信号识别网络模型进行训练和验证，得到最终的干扰信号识别网络模型；7)利用模型各对类干扰信号进行准确识别。本发明能够实现对干扰信号全局和局部特征的全面提取，以及时域和频域特征的充分融合，有效提升了干扰信号的识别准确率。
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