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公开(公告)号：CN108055233A
公开(公告)日：2018-05-18
申请号：CN201711037529.0
申请日：2017-10-30
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司
摘要： 本发明涉及一种安全芯片的多算法处理方法及装置，方法包括：根据操作请求，获取与所述操作请求中对应文件的密钥索引值KID；根据所述文件的密钥索引值KID，在密钥文件中查找与所述密钥索引值KID对应的密钥以及与算法标识，其中，所述密钥文件中存储有密钥索引值KID、与所述KID对应的密钥以及与所述KID对应的算法标识；根据与所述KID对应的密钥以及所述算法标识，执行与操作请求中对应的操作。本发明提供的安全芯片的多算法处理方法及装置，解决了在同一应用中，只能使用一种算法的问题，可以采用不同的算法进行应用文件的操作，提升了安全芯片灵活处理应用的能力。
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公开(公告)号：CN107132472A
公开(公告)日：2017-09-05
申请号：CN201710372213.0
申请日：2017-05-23
申请人： 北京智芯微电子科技有限公司 , 国家电网公司 , 国网信息通信产业集团有限公司
IPC分类号： G01R31/307 , H01L21/311
摘要： 本发明公开了一种用于分析深亚微米级SOI工艺芯片的腐蚀溶液及方法，其中，该方法包括：利用特性腐蚀溶液腐蚀掉待测芯片的器件层上的二氧化硅，特性腐蚀溶液包括：氢氟酸、二氧化硅刻蚀液、丙三醇和水；将腐蚀后的待测芯片用去离子水清洗后晾干；将晾干后的待测芯片放置于反性酸性染色溶液中进行染色处理，反性酸性染色溶液包括：氢氟酸、硝酸和冰醋酸；根据扫描电子显微镜采集的染色后的待测芯片的图像数据确定待测芯片的类型。该特性腐蚀溶液可以实现均匀腐蚀性，并且能有效的降低反应速度，保证成功率，且可以平整保留器件层；染色处理后的待测芯片非常平整，方便快速确定待测芯片的类型。
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公开(公告)号：CN106940523A
公开(公告)日：2017-07-11
申请号：CN201710190594.0
申请日：2017-03-28
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司
IPC分类号： G04R20/00
摘要： 本发明涉及一种基于低频时码技术的授时装置，包括：信号解调模块和数据处理模块，所述信号解调模块包括磁棒天线、信号调制单元、第一主控单元，所述磁棒天线通过所述信号调制单元与所述第一主控单元相连；所述数据处理模块包括第二主控单元；所述第一主控单元与所述第二主控单元进行通信。本发明实施例公开的一种基于低频时码技术的授时装置，有如下优点：所有终端设备可以进行统一校时，校时信号覆盖范围广泛。无需网络连接和人工干预，每天24小时自动校时。授时精度高，无累计误差。节省RTC相关电路，仅增加可靠的低频时码接收电路，节省了成本。本发明实施例提出的授时装置，解决了智能电网终端因计时不准导致的用户计费不准等问题。
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公开(公告)号：CN106934153A
公开(公告)日：2017-07-07
申请号：CN201710145290.2
申请日：2017-03-13
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司 , 国网河北省电力公司
IPC分类号： G06F17/50
CPC分类号： G06F17/5009 , G06F17/5068
摘要： 本发明公开了一种提取器件模型参数的方法及装置，其中，该方法包括：根据待测器件模型的待测参数确定测试输入和与测试输入相对应的测试数据，测试输入包括测试输入和测试电路；根据测试电路确定仿真网表，仿真网表用于记录待测器件各个引脚的连接关系；确定待测参数的临时参数值，并将测试输入作为仿真网表的输入，确定仿真网表输出的仿真数据；在仿真数据与测试数据之间的差值小于预设阈值时，将临时参数值作为待测参数的有效参数值。该方法可以快速准确地确定待测器件模型的参数；该方法避免使用提参软件，不需要支付额外的费用，代价低，同时可以重复确定待测器件模型的参数。
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公开(公告)号：CN106599974A
公开(公告)日：2017-04-26
申请号：CN201611140950.X
申请日：2016-12-12
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司
IPC分类号： G06K19/077
摘要： 本发明涉及一种电子标签的电源整流电路，包括：控制电路、第一整流及电压调整电路、第二整流及电压调整电路、电源检测电路以及稳压电容；通过电源检测电路采集所述稳压电容的第一端的电压，根据所述稳压电容的第一端的电压向所述控制电路发送反馈信号；控制电路用于根据所述反馈信号、第一天线信号和第二天线信号控制所述第一整流及电压调整电路或所述第二整流及电压调整电路对所述稳压电容进行充电，通过电源检测电路控制稳压电容第一端的电压在芯片工作的所需范围内，电路结构简单并且减少芯片面积。
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公开(公告)号：CN106599971A
公开(公告)日：2017-04-26
申请号：CN201611142363.4
申请日：2016-12-12
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司
CPC分类号： G06K19/0701 , H02J5/005 , H02J7/025
摘要： 本发明实施例提供了一种电子标签电源整流电路，包括：能量获取电路、充电控制电路、电源检测电路、输出稳压电容，所述能量获取电路的第一输入端与第一天线相连，第二输入端与第二天线相连，输出端与所述充电控制电路的输入端相连；所述第一天线和所述第二天线不同时输出高电平；所述充电控制电路的控制端与所述第一天线、所述第二天线、所述电源检测电路的输出端分别相连，所述充电控制电路的输出端与所述输出稳压电容的第一端、电源电压分别相连；所述电源检测电路的输入端与所述输出稳压电容的第二端相连；所述输出稳压电容的第二端接地。
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公开(公告)号：CN106301761A
公开(公告)日：2017-01-04
申请号：CN201610647528.7
申请日：2016-08-09
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司
IPC分类号： H04L9/06
CPC分类号： H04L9/0643 , H04L2209/125
摘要： 本发明涉及一种基于密码杂凑算法的压缩方法及装置，方法包括：获取各变量字的初值和预计算扩展字；对第一变量字、第二变量字、第三变量字的初值进行布尔函数处理；将预计算扩展字、第一变量字的初值、补偿结果以及布尔函数处理后的结果进行压缩加和处理，其中，补偿结果为进行预设位数移位后的常数与预设的补偿值的和；对压缩加和处理后的结果进行选择；对选择后的加和处理后结果进行置换运算，得到当前周期的第一变量字的压缩结果，可以缩短算法中的关键路径，降低关键路径时延，提高电路的吞吐率。
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公开(公告)号：CN105183978A
公开(公告)日：2015-12-23
申请号：CN201510557112.1
申请日：2015-09-02
申请人： 北京智芯微电子科技有限公司 , 国家电网公司
IPC分类号： G06F17/50
摘要： 本发明公开了一种芯片设计阶段可靠性评估方法和装置，其中，该方法包括：根据确定的芯片功能划分功能模块，并根据所述功能模块的需求进行网表设计；根据BSIM器件模型对所述网表进行前仿真，当前仿真结果满足所述功能模块的需求时，进行版图绘制；在版图绘制完成后，提取布线后的寄生的电容和电阻，根据BSIM器件模型对提取后的网表进行后仿真；当后仿真结果满足所述功能模块的需求时，根据预先建立的老化BSIM器件模型再次进行仿真；当再次仿真结果满足所述功能模块的需求时，则进行制版流片。本发明的芯片设计阶段可靠性评估方法和装置，与传统的开发流程相比，可以缩小产品的开发周期，减少修改光刻板的次数，进而降低开发成本。
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公开(公告)号：CN105069258A
公开(公告)日：2015-11-18
申请号：CN201510556699.4
申请日：2015-09-02
申请人： 北京智芯微电子科技有限公司 , 国家电网公司
IPC分类号： G06F17/50
摘要： 本发明公开了一种芯片设计可靠性的评估方法及装置，其中，该方法包括：确定电路板图设计后，提取电路设计参数；给定电路温度，根据电路参数和电路温度确定电路中器件的功耗分布；对电路板图进行网格化处理，并根据功耗分布计算每个网格在对应功耗下的温度，确定温度分布，并将温度分布反馈给电路中的相应的电路器件；重复上述确定功耗分布和温度分布的步骤，确定温度收敛时的收敛温度分布；并根据温度与电路器件工作寿命之间的关系确定电路器件的工作寿命；在工作寿命大于预设寿命时设计制作电路板。该方法通过对电路板图进行网格化处理，从而可以实现精细化热电仿真，可以大大的缩小产品的开发周期，进而降低开发成本。
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公开(公告)号：CN206991158U
公开(公告)日：2018-02-09
申请号：CN201720932378.4
申请日：2017-07-28
申请人： 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国家电网公司
摘要： 本实用新型公开了一种具有高安全特性的高速芯片时钟发生器，其包含：晶体振荡器、多条键合线以及SOC芯片。晶体振荡器用以提供低频时钟信号；SOC芯片与晶体振荡器采用多芯片封装技术封装到一个封装管壳腔体中，且SOC芯片包含：锁相环模块，其通过多条键合线与晶体振荡器连接，且锁相环模块接收晶体振荡器的低频时钟信号；其中，锁相环模块将低频时钟信号倍频至高频时钟信号，并将高频时钟信号提供给SOC芯片作为基本工作时钟。借此，本实用新型的具有高安全特性的高速芯片时钟发生器，时钟信号具有较小的抖动，时钟质量可靠。
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