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公开(公告)号:CN106448733B
公开(公告)日:2022-04-12
申请号:CN201610665846.6
申请日:2016-08-12
申请人: 三星电子株式会社
摘要: 本发明公开了非易失性存储器设备和编程方法和其编程验证方法。一种用于非易失性存储器设备的编程验证方法,包括:关于第一级执行第一失败位计数操作以生成第一失败位累积值,并且将第一失败位累积值与第一失败参考值相比较以确定编程失败。当第一失败位累积值小于第一失败参考值时,执行用于第二阶段的第二失败位计数操作以生成第二失败位累积值。将第二失败位累积值与第二参考值相比较以确定编程失败。第二失败参考值不同于第一失败参考值。
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公开(公告)号:CN107017028A
公开(公告)日:2017-08-04
申请号:CN201611168375.4
申请日:2016-12-16
申请人: 三星电子株式会社
IPC分类号: G11C16/34
CPC分类号: G11C16/3459 , G11C11/5671 , G11C16/08 , G11C16/10 , G11C16/3481 , G11C2211/562 , G11C2211/5621 , G11C2211/5644 , G11C16/3454
摘要: 提供了一种非易失性存储器设备。存储单元阵列包括多个存储单元。地址译码器在第一编程循环中将第一验证电压提供至多个存储单元当中的所选择的存储单元,并且在第二编程循环中将第二验证电压提供至所选择的存储单元。控制逻辑基于第一编程循环的验证操作的结果,将第二编程循环确定为验证电压偏移点,在验证电压偏移点中将第一验证电压改变为第二验证电压。
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公开(公告)号:CN109841254A
公开(公告)日:2019-06-04
申请号:CN201811406794.6
申请日:2018-11-23
申请人: 三星电子株式会社
摘要: 一种非易失性存储设备包含多个存储单元,所述存储单元包含第一存储单元和第二存储单元。一种对非易失性存储设备进行编程的方法,包含:执行第一编程,以将编程强制电压施加到每个第一存储单元的位线;并且在执行第一编程之后基于第二存储单元的阈值电压,将第二存储单元划分为第一单元组、第二单元组和第三单元组。所述方法还包含执行第二编程,以将编程禁止电压施加到每个第一存储单元的位线和第一单元组的每个存储单元的位线。所述编程强制电压的电平低于编程禁止电压的电平。
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公开(公告)号:CN107422982A
公开(公告)日:2017-12-01
申请号:CN201710236665.6
申请日:2017-04-12
申请人: 三星电子株式会社
IPC分类号: G06F3/06
CPC分类号: G06F3/0619 , G06F3/0653 , G06F3/0659 , G06F3/0679 , G06F3/0688 , G06F11/1048 , G06F11/1068 , G11C11/5642 , G11C16/0483 , G11C16/26 , G11C29/52 , G06F3/0614 , G06F3/0629
摘要: 本发明涉及一种包括非易失性存储器和控制器的存储装置,所述控制器配置为根据外部主机装置的请求生成读取命令并传输读取命令至非易失性存储器。非易失性存储器配置为响应读取命令执行读取操作,输出读取数据至控制器,并储存读取操作的信息在内部寄存器中。
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公开(公告)号:CN107305791A
公开(公告)日:2017-10-31
申请号:CN201710096000.X
申请日:2017-02-22
申请人: 三星电子株式会社
CPC分类号: G06F11/1402 , G06F2201/805 , G06F2201/82 , G11C11/5642 , G11C16/26 , G11C16/3418 , G11C16/349 , G11C16/3495 , G11C29/4401 , G11C16/3454
摘要: 提供了存储装置和存储系统。所述存储装置包括:存储单元阵列,包括多个存储单元;计数电路,配置为通过对从所述多个存储单元读取的数据执行计数操作获得计数结果;以及控制逻辑,配置为在不涉及存储控制器的情况下基于计数结果执行数据恢复操作。
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公开(公告)号:CN109841254B
公开(公告)日:2024-04-05
申请号:CN201811406794.6
申请日:2018-11-23
申请人: 三星电子株式会社
摘要: 一种非易失性存储设备包含多个存储单元,所述存储单元包含第一存储单元和第二存储单元。一种对非易失性存储设备进行编程的方法,包含:执行第一编程,以将编程强制电压施加到每个第一存储单元的位线;并且在执行第一编程之后基于第二存储单元的阈值电压,将第二存储单元划分为第一单元组、第二单元组和第三单元组。所述方法还包含执行第二编程,以将编程禁止电压施加到每个第一存储单元的位线和第一单元组的每个存储单元的位线。所述编程强制电压的电平低于编程禁止电压的电平。
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