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    处理器
    1.
    发明授权
    处理器 有权 转让

    公开(公告)号：CN102483708B

    公开(公告)日：2016-01-20

    申请号：CN201180003728.4

    申请日：2011-07-06

    申请人： 松下电器产业株式会社

    发明人： 森下广之

    IPC分类号： G06F9/52 ,  G06F9/38

    CPC分类号： G06F9/3009 ,  G06F9/30047 ,  G06F9/30076 ,  G06F9/3834 ,  G06F9/3838 ,  G06F9/3851 ,  G06F9/4812 ,  G06F9/4843 ,  G06F9/526

    摘要： 提供能够保持多个指令与一个读出指令之间的依存关系的处理器。执行多个线程的处理器具有：设定单元，在执行一个线程中的确保向存储器区域完成了写入的位置上存在的指令时，对表示是否向该存储器区域完成了写入的利用信息，设定表示该一个线程向该存储器区域完成了写入之意的内容，上述一个线程向上述存储器区域进行写入，上述存储器区域由上述一个线程与另一线程共同利用；以及控制单元，在上述利用信息表示上述一个线程向上述存储器区域完成了写入的情况下，执行另一线程读出上述存储器区域中存在的数据的读出指令，在上述利用信息表示上述一个线程向上述存储器区域完成了写入的情况下，抑制执行该读出指令。

    处理器
    2.
    发明公开
    处理器 有权 转让

    公开(公告)号：CN102483708A

    公开(公告)日：2012-05-30

    申请号：CN201180003728.4

    申请日：2011-07-06

    申请人： 松下电器产业株式会社

    发明人： 森下广之

    IPC分类号： G06F9/52 ,  G06F9/38

    CPC分类号： G06F9/3009 ,  G06F9/30047 ,  G06F9/30076 ,  G06F9/3834 ,  G06F9/3838 ,  G06F9/3851 ,  G06F9/4812 ,  G06F9/4843 ,  G06F9/526

    摘要： 提供能够保持多个指令与一个读出指令之间的依存关系的处理器。执行多个线程的处理器具有：设定单元，在执行一个线程中的确保向存储器区域完成了写入的位置上存在的指令时，对表示是否向该存储器区域完成了写入的利用信息，设定表示该一个线程向该存储器区域完成了写入之意的内容，上述一个线程向上述存储器区域进行写入，上述存储器区域由上述一个线程与另一线程共同利用；以及控制单元，在上述利用信息表示上述一个线程向上述存储器区域完成了写入的情况下，执行另一线程读出上述存储器区域中存在的数据的读出指令，在上述利用信息表示上述一个线程向上述存储器区域完成了写入的情况下，抑制执行该读出指令。

    多线程处理器
    3.
    发明公开
    多线程处理器 失效

    公开(公告)号：CN101178646A

    公开(公告)日：2008-05-14

    申请号：CN200710185094.4

    申请日：2007-11-08

    申请人： 松下电器产业株式会社

    发明人： 森下广之 ,  尾崎伸治 ,  山本崇夫 ,  中岛雅逸

    IPC分类号： G06F9/38 ,  H04N7/26

    CPC分类号： G06F9/3885 ,  G06F9/3802 ,  G06F9/3814 ,  G06F9/3851

    摘要： 一种多线程处理器，可以准确地估算对线程需要的处理时间，并且同时执行多个指令流，该多线程处理器包括：运算器群组，执行多个指令；指令调度器，按每个所述指令流，对在该指令流中包含的指令进行分组，从而分为由可以向所述运算器群组同时发行的指令组成的组；指令缓冲器，以由所述指令调度器分成的组为单位，并按每个所述指令流保存在该指令流中包含的指令；以及发行指令决定部，按多线程处理器的每个执行周期，以组为单位从所述指令缓冲器读出指令，并向所述运算器群组发行读出后的所述指令。

    处理器
    4.
    发明授权
    处理器 有权 转让

    公开(公告)号：CN102428441B

    公开(公告)日：2015-04-08

    申请号：CN201080021569.6

    申请日：2010-05-18

    申请人： 松下电器产业株式会社

    发明人： 森下广之

    IPC分类号： G06F9/38 ,  G06F9/46 ,  G06F9/50

    CPC分类号： G06F9/3851 ,  G06F9/3889

    摘要： 本发明的目的在于提供一种处理器，能够一并实现针对一个命令流的性能保证和针对其它命令流的高响应性。一种具有L个(L为2以上的整数)运算器的处理器，具有：命令缓冲器，被分别输入M个(M为2以上的整数)命令流，包含M×Z个命令存储区域，以用来存储构成各命令流的Z个(Z为2以上的整数，且满足M×Z为L以上)命令；顺序信息保存单元，保存顺序信息，该顺序信息是对所述命令缓冲器内的所述M×Z个命令存储区域赋予了顺序的信息；提取单元，用于提取在所述命令缓冲器的所述M×Z个命令存储区域中存储的命令；以及控制单元，使所述提取单元按照基于所述顺序信息的顺序，从在所述M×Z个命令存储区域中存储的成为可执行状态的所有命令中提取L个命令，并将提取出的每个命令输入到不同运算器中。

    处理器
    5.
    发明公开
    处理器 有权 转让

    公开(公告)号：CN102428441A

    公开(公告)日：2012-04-25

    申请号：CN201080021569.6

    申请日：2010-05-18

    申请人： 松下电器产业株式会社

    发明人： 森下广之

    IPC分类号： G06F9/38 ,  G06F9/46 ,  G06F9/50

    CPC分类号： G06F9/3851 ,  G06F9/3889

    摘要： 本发明的目的在于提供一种处理器，能够一并实现针对一个命令流的性能保证和针对其它命令流的高响应性。一种具有L个(L为2以上的整数)运算器的处理器，具有：命令缓冲器，被分别输入M个(M为2以上的整数)命令流，包含M×Z个命令存储区域，以用来存储构成各命令流的Z个(Z为2以上的整数，且满足M×Z为L以上)命令；顺序信息保存单元，保存顺序信息，该顺序信息是对所述命令缓冲器内的所述M×Z个命令存储区域赋予了顺序的信息；提取单元，用于提取在所述命令缓冲器的所述M×Z个命令存储区域中存储的命令；以及控制单元，使所述提取单元按照基于所述顺序信息的顺序，从在所述M×Z个命令存储区域中存储的成为可执行状态的所有命令中提取L个命令，并将提取出的每个命令输入到不同运算器中。

    处理器
    8.
    发明公开
    处理器 失效

    公开(公告)号：CN101031884A

    公开(公告)日：2007-09-05

    申请号：CN200680000804.5

    申请日：2006-04-12

    申请人： 松下电器产业株式会社

    发明人： 森下广之 ,  桥本隆 ,  清原督三

    IPC分类号： G06F9/46

    摘要： 本发明涉及的处理器，是循环地按照分配给线程的时间来执行多个线程的处理器，其具备可重构的集成电路；事先存储与多个线程的各个对应的电路构成信息，根据电路构成信息将上述集成电路的一部分进行重构，依次使用根据对应于线程的电路构成信息进行了重构的集成电路，执行该线程。在执行某线程的期间，选择下面执行的线程，对于正在执行的线程在使用的上述集成电路部分之外的部分，为了下面执行的线程而进行重构。

    控制处理器和协处理器间的数据传输的运算处理装置
    9.
    发明公开
    控制处理器和协处理器间的数据传输的运算处理装置 有权

    公开(公告)号：CN1749955A

    公开(公告)日：2006-03-22

    申请号：CN200510113272.3

    申请日：2005-07-06

    申请人： 松下电器产业株式会社

    发明人： 前田昌树 ,  森下广之 ,  田中健 ,  清原督三

    IPC分类号： G06F9/38

    CPC分类号： G06F9/3877 ,  G06F9/3885

    摘要： 一种具备主处理器和协处理器的运算处理装置，主处理器具有：根据运算指令进行运算时用于保存运算对象或结果的多个寄存器、和逐次解释指令并进行根据指令的控制的指令解释控制部，此指令解释控制部利用操作数来指定：在上述协处理器中应执行的运算处理的种类、表示保存该运算处理对象的第一寄存器的信息和表示应保存上述协处理器进行运算处理的结果的第二寄存器的信息，通过解释用于请求向协处理器的运算的1条指令即协处理器运算指令，从而进行下述控制：在上述协处理器中，将第一寄存器的内容作为运算处理对象以执行该种类的运算处理，进而将由上述协处理器生成的此运算处理结果写入第二寄存器。