公开(公告)号：US09218443B1

公开(公告)日：2015-12-22

申请号：US14539975

申请日：2014-11-12

Applicant: Xilinx, Inc.

Inventor： Henry E. Styles ,  Jeffrey M. Fifield ,  Ralph D. Wittig ,  Philip B. James-Roxby ,  Sonal Santan ,  Devadas Varma ,  Fernando J. Martinez Vallina ,  Sheng Zhou ,  Charles Kwah-Wah Lo

IPC: G06F17/50

CPC classification number: G06F17/505 ,  G06F8/451

Abstract: OpenCL program compilation may include generating, using a processor, a register transfer level (RTL) description of a first kernel of a heterogeneous, multiprocessor design and integrating the RTL description of the first kernel with a base platform circuit design. The base platform circuit design provides a static interface within a programmable integrated circuit to a host of the heterogeneous, multiprocessor design. A first configuration bitstream may be generated from the RTL description of the first kernel using the processor. The first configuration bitstream specifies a hardware implementation of the first kernel and supporting data for the configuration bitstream. The first configuration bitstream and the supporting data may be included within a binary container.

Abstract translation: OpenCL程序编译可以包括使用处理器来生成异构多处理器设计的第一内核的寄存器传送级（RTL）描述，并将第一内核的RTL描述与基本平台电路设计集成。 基础平台电路设计为可编程集成电路内的静态接口提供了异构多处理器设计的主机。 可以使用处理器从第一内核的RTL描述生成第一配置比特流。 第一配置比特流指定第一内核的硬件实现和配置比特流的支持数据。 第一配置比特流和支持数据可以包括在二进制容器内。