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公开(公告)号：CN102652392A
公开(公告)日：2012-08-29
申请号：CN201180004698.9
申请日：2011-01-07
申请人： 松下电器产业株式会社
CPC分类号： H03F3/505 , H03F1/0277 , H03F1/3205 , H03F3/195 , H03F3/211 , H03F3/72 , H03F2200/165 , H03F2200/168 , H03F2200/171 , H03F2200/294 , H03F2200/513 , H03F2203/5031 , H03G3/3063 , H03J2200/10 , H04B1/1638
摘要： 本发明公开了一种半导体集成电路及包括该半导体集成电路的调谐系统。半导体集成电路包括衰减器(10)、源极输出器(20)和放大单元(30)，该衰减器(10)使已输入的信号以可变衰减量衰减，该源极输出器(20)接收衰减器(10)的输出，该放大单元(30)先对源极输出器(20)的输出进行滤波处理，然后以可变增益将该滤波处理后的输出放大。因此，在已被集成电路化的RF信号处理电路中，能够实现即使是在进行低电压工作时也良好的失真特性。
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公开(公告)号：CN101504868A
公开(公告)日：2009-08-12
申请号：CN200910005713.6
申请日：2009-02-03
申请人： 联发科技股份有限公司
发明人： 周煜凯
IPC分类号： G11C27/02
CPC分类号： G11C27/026 , H03F3/505 , H03F2203/5031
摘要： 本发明提供一种取样维持放大器，所述取样维持放大器包括取样维持电路及缓冲电路。取样维持电路接收输入信号，且根据控制信号来将输入信号传送至第一节点。缓冲电路耦接于供电电源与接地端之间，且受控于第一节点以提供输出信号至输出节点。缓冲电路包括原生金属氧化物半导体晶体管，且所述原生金属氧化物半导体晶体管耦接于输出节点。
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公开(公告)号：CN101501986A
公开(公告)日：2009-08-05
申请号：CN200780029143.3
申请日：2007-07-31
申请人： 模拟装置公司
发明人： 劳伦斯·A·辛格 , 罗纳德·A·卡普斯塔
CPC分类号： H03F1/0283 , H03F3/505 , H03F2200/24 , H03F2200/421 , H03F2200/453 , H03F2200/456 , H03F2203/5027 , H03F2203/5031 , H03F2203/5036
摘要： 两个或更多个缓冲器可以被配置和布置成使得流过并且偏置第一缓冲器的静态电流也流过并且偏置第二缓冲器。第一和第二缓冲器可以例如是作为驱动开关电容器电路的输入的参考缓冲器来使用的源极跟随器。
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公开(公告)号：CN101501986B
公开(公告)日：2012-02-22
申请号：CN200780029143.3
申请日：2007-07-31
申请人： 美国亚德诺半导体公司
发明人： 劳伦斯·A·辛格 , 罗纳德·A·卡普斯塔
CPC分类号： H03F1/0283 , H03F3/505 , H03F2200/24 , H03F2200/421 , H03F2200/453 , H03F2200/456 , H03F2203/5027 , H03F2203/5031 , H03F2203/5036
摘要： 两个或更多个缓冲器可以被配置和布置成使得流过并且偏置第一缓冲器的静态电流也流过并且偏置第二缓冲器。第一和第二缓冲器可以例如是作为驱动开关电容器电路的输入的参考缓冲器来使用的源极跟随器。
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公开(公告)号：CN101558557A
公开(公告)日：2009-10-14
申请号：CN200780013883.8
申请日：2007-04-19
申请人： 德克萨斯仪器股份有限公司
IPC分类号： H03F3/04
CPC分类号： G05F3/262 , H03F3/345 , H03F3/505 , H03F2200/453 , H03F2203/5027 , H03F2203/5031
摘要： 一种对栅极泄漏不敏感的电流镜电路(100)其包括输入级(110)、输出级(120)和一对互补源极跟随器(130)。这对互补源极跟随器连接在该输入级和该输出级之间。在操作过程中，输入级接收输入电流，这对互补源极跟随器接收第一电流源和第二电流源。然后输出级提供输出电流。互补源极跟随器形成负反馈回路并为输入级和输出级建立偏置电压，该偏置电压是独立于输入级和输出级之间的栅极泄漏的输入电流的函数。
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公开(公告)号：CN101204005A
公开(公告)日：2008-06-18
申请号：CN200680012566.X
申请日：2006-04-13
申请人： 美调(德克萨斯州)有限合伙公司
发明人： 菲利普·T·希萨雅索 , 迈克尔·D·沃马克
CPC分类号： H03H7/12 , H03F1/22 , H03F3/19 , H03F3/50 , H03F2200/108 , H03F2200/294 , H03F2200/411 , H03F2200/489 , H03F2200/501 , H03F2203/5031 , H03H7/06 , H03H7/1758 , H03H11/1213 , H03H11/1291 , H03J3/20 , H03J2200/10
摘要： 一种电路包括：包括连接到第一可变电容器的第一电感器的第一滤波器，其中，第一滤波器与第一谐振频率相关联。该电路还包括连接到第一滤波器的放大器和连接到该放大器的第二滤波器。第二滤波器包括连接到第二可变电容器的第二电感器，其中，第二滤波器与基本与第一谐振频率相同的第二谐振频率相关联。第一滤波器的至少一部分和第二滤波器的至少一部分形成于一个集成电路上。
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公开(公告)号：CN108141187A
公开(公告)日：2018-06-08
申请号：CN201680061333.2
申请日：2016-09-13
申请人： 法尔科姆斯有限公司
CPC分类号： H03F3/345 , H03F1/223 , H03F1/3205 , H03F3/082 , H03F3/505 , H03F2200/456 , H03F2203/5031
摘要： 一种跨导电路，具有：输入端(VIN)和输出端(Out)；第一电流源(4)，具有连接至所述输入端(VIN)的栅极；以及第二电流源(5)，与所述第一电流源并联，并且比所述第一电流源具有更高的跨导和更宽的动态范围。所述电流源被配置为使得在低输入电压处，仅所述第一电流源(4)导通。一种电压降电路(2)，相比于给所述第一电流源，给所述第二电流源提供更低的偏置电压。
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公开(公告)号：CN105790765A
公开(公告)日：2016-07-20
申请号：CN201510833560.X
申请日：2015-11-25
申请人： 联发科技股份有限公司
IPC分类号： H03M1/12
CPC分类号： H03M3/332 , H03F3/505 , H03F2200/331 , H03F2203/5021 , H03F2203/5031 , H03F2203/5033 , H03M1/00 , H03M1/0641 , H03M1/12 , H03M3/458
摘要： 本发明提供了一种用于减少模数转换器中的寄生噪声音调的差分模数转换器和方法。该差分模数转换器包括：差分模拟输入端，包括第一信号输入端和第二信号输入端；第一ADC，连接于在第一信号路径中的该第一信号输入端；第二ADC，连接于在第二信号路径中的该第二信号输入端；抖动输入端，用于接收一抖动信号，且该抖动信号耦接于该第一信号路径和该第二信号路径，使得该抖动信号抖动该第一ADC的第一数字输出信号和该第二ADC的第二数字输出信号；以及差分组件，用于接收该第一ADC的第一数字输出信号和该第二ADC的第二数字输出信号，并输出一整体数字输出信号，该整体数字输出信号包括该第一数字输出信号和该第二数字输出信号之间的差异。
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公开(公告)号：CN104617900A
公开(公告)日：2015-05-13
申请号：CN201510024084.7
申请日：2015-01-19
申请人： 信阳农林学院
IPC分类号： H03F3/68
CPC分类号： H03F3/68 , H03F2203/5031 , H03F2203/5039
摘要： 本发明公开了一种网络信号传输放大电路，包括直流电源、第一电阻至第十电阻、第一电容至第五电容、第一运算放大器、第二运算放大器、三极管、网络信号输入端和网络信号输出端，与现有技术相比，本发明网络信号经过第一运算放大器放大，放大后的信号经过第三电容滤波，再经第二运算放大器第二次放大，放大后的信号经三极管再次放大后输出至网络信号输出端，从而有效的提高网络信号传输速度，提高工作效率，使用方便，具有推广应用的价值。
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公开(公告)号：CN101989842A
公开(公告)日：2011-03-23
申请号：CN201010243671.2
申请日：2010-08-02
申请人： 瑞萨电子株式会社
CPC分类号： H03F3/505 , G09G3/3688 , H03F3/3022 , H03F3/45219 , H03F3/45475 , H03F2203/45138 , H03F2203/45302 , H03F2203/45311 , H03F2203/45396 , H03F2203/45631 , H03F2203/45722 , H03F2203/5031
摘要： 本发明提供一种运算放大器和使用运算放大器的半导体器件。该运算放大器提供有：第一MOS晶体管对，所述第一MOS晶体管对被连接至非反相输入端子和反相输入端子；中间级，所述中间级被连接至第一MOS晶体管对；第一输出晶体管，所述第一输出晶体管具有与输出端子相连接的漏极；以及第一源极跟随器。第一源极跟随器被插入在第一输出晶体管的栅极与中间级的第一输出节点之间。
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