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    Single-chip microcomputer
    9.
    发明公开
    Single-chip microcomputer 失效
    Einchip-Mikrocomputer

    公开(公告)号：EP0718779A1

    公开(公告)日：1996-06-26

    申请号：EP96102998.0

    申请日：1994-08-10

    申请人： HITACHI, LTD. ,  HITACHI MICROCOMPUTER SYSTEM LTD.

    发明人： Kawasaki, Shumpei ,  Akao, Yasushi ,  Noguchi, Kouki ,  Hasegawa, Atsushi ,  Ohsuga, Hiroshi ,  Kurakazu, Keiichi ,  Matsubara, Kiyoshi ,  Hayakawa, Akio ,  Ito, Yoshitaka

    IPC分类号： G06F13/42 ,  G06F13/40 ,  G06F15/78

    CPC分类号： G06F9/3001 ,  G06F12/0893 ,  G06F13/36 ,  G06F13/405 ,  G06F15/7817 ,  H04W28/08 ,  H04W52/0216 ,  H04W88/02 ,  Y02D10/12 ,  Y02D10/13 ,  Y02D10/14 ,  Y02D10/151 ,  Y02D70/142 ,  Y02D70/26

    摘要： A single-chip microcomputer comprising: a first bus having a central processing unit and a cache memory connected therewith; a second bus having a dynamic memory access control circuit and an external bus interface connected therewith; a break controller for connecting the first bus and the second bus selectively; a third bus having a peripheral module connected therewith and having a lower-speed bus cycle than the bus cycles of the first and second buses; and a bus state controller for effecting a data transfer and a synchronization between the second bus and the third bus. The single-chip microcomputer has the three divided internal buses to reduce the load capacity upon the signal transmission paths so that the signal transmission can be accomplished at a high speed. Moreover, the peripheral module required to have no operation speed is isolated so that the power dissipation can be reduced.

    摘要翻译： 一种单片微计算机，包括：具有中央处理单元和与其连接的高速缓冲存储器的第一总线; 具有动态存储器访问控制电路和与其连接的外部总线接口的第二总线; 用于选择性地连接第一总线和第二总线的断开控制器; 第三总线具有与其连接的外围模块，并且具有比第一和第二总线的总线周期更低的总线周期; 以及用于进行数据传送和第二总线与第三总线之间的同步的总线状态控制器。 单片机具有三条分开的内部总线，以减少信号传输路径上的负载能力，从而可以高速实现信号传输。 此外，隔离所需要的没有运行速度的外围模块，从而可以降低功耗。

    Microcomputer and microcomputer system
    10.
    发明公开
    Microcomputer and microcomputer system 失效
    Mikrocomputer和Mikrocomputersystem。

    公开(公告)号：EP0597307A1

    公开(公告)日：1994-05-18

    申请号：EP93117256.3

    申请日：1993-10-25

    申请人： HITACHI, LTD. ,  HITACHI MICROCOMPUTER SYSTEM LTD. ,  HITACHI VLSI ENGINEERING CORPORATION

    发明人： Kawasaki, Shumpei ,  Fukada, Kaoru ,  Watabe, Mitsuru ,  Noguchi, Kouki ,  Matsubara, Kiyoshi ,  Mochizuki, Isamu ,  Suzukawa, Kazufumi ,  Masumura, Shigeki ,  Akao, Yasushi ,  Sakakibara, Eiji

    IPC分类号： G06F13/42 ,  G06F15/78

    CPC分类号： G06F15/7832 ,  G06F13/4239 ,  G06F15/786

    摘要： A microcomputer that is easy to use and connected direct to such memories as dynamic and static RAM's and to other peripheral circuits. The microcomputer has strobe signal output terminals CASH * , CASL * and RAS * for direct connection to a dynamic RAM, and chip select signal output terminals CSO * through CS6 * for outputting a chip select signal in parallel with the output from the strobe signal output terminals. The microcomputer further includes address output terminals for outputting a non-multiplexed or multiplexed address signal as needed, and data I/O terminals for selectively outputting the address signal to comply with a multiple-bus interface scheme.

    摘要翻译： 一种易于使用和直接连接到诸如动态和静态RAM以及其他外围电路之类的存储器的微型计算机。 微型计算机具有选通信号输出端子CASH *，CASL *和RAS *，用于直接连接到动态RAM，以及芯片选择信号输出端子CS0 *至CS6 *，用于与选通信号输出的输出并行输出芯片选择信号 终端。 微型计算机还包括用于根据需要输出未复用或复用的地址信号的地址输出端子和用于选择性地输出地址信号以符合多总线接口方案的数据I / O端子。