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    Degradable LRU circuit
    11.
    发明授权
    Degradable LRU circuit 失效
    可降级LRU电路

    公开(公告)号：US4361878A

    公开(公告)日：1982-11-30

    申请号：US200876

    申请日：1980-10-27

    申请人： Thomas A. Lane ,  David M. Webb

    发明人： Thomas A. Lane ,  David M. Webb

    IPC分类号： G01R22/00 ,  G06F12/12 ,  G06F1/00

    CPC分类号： G06F12/126 ,  G01R22/00 ,  G06F2212/1032

    摘要： A modified least recently used resolving network provides the capability of ignoring any one or more of the signals indicating use of the device in resolving the least recently used status of the devices.

    摘要翻译： 经修改的最近最少使用的解析网络提供忽略指示使用设备在解决设备的最近最少使用状态中的任何一个或多个信号的能力。

    Quantitative trait loci associated with soybean cyst nematode resistance and uses thereof
    14.
    发明授权
    Quantitative trait loci associated with soybean cyst nematode resistance and uses thereof 失效
    与大豆孢囊线虫抗性相关的定量性状位点及其用途

    公开(公告)号：US06538175B1

    公开(公告)日：2003-03-25

    申请号：US09542500

    申请日：2000-04-03

    申请人： David M. Webb

    发明人： David M. Webb

    IPC分类号： A01H102

    CPC分类号： A01H5/10 ,  C07K14/415 ,  C12N15/8285 ,  C12Q1/6827 ,  C12Q1/683 ,  C12Q1/6858 ,  C12Q1/6895 ,  C12Q2600/13 ,  C12Q2600/156 ,  Y02A40/164

    摘要： A method for selecting a soybean cyst nematode resistant plant by marker assisted selection of quantitative trait loci associated with soybean cyst nematode resistance. The method employs nucleic acid markers genetically linked to quantitative trait loci to select the soybean cyst nematode resistant plant. Methods for identifying quantitative trait loci associated with soybean cyst nematode resistance in a plant.

    摘要翻译： 通过与大豆孢囊线虫抗性相关的数量性状位点的标记辅助选择来选择大豆孢子线虫抗性植物的方法。 该方法采用与数量性状基因座遗传连锁的核酸标记，选择大豆胞囊线虫抗性植物。 用于鉴定植物中与大豆孢囊线虫抗性相关的数量性状位点的方法。

    Look-ahead instruction fetch control for a cache memory
    16.
    发明授权
    Look-ahead instruction fetch control for a cache memory 失效
    用于高速缓冲存储器的先行指令获取控制

    公开(公告)号：US4761731A

    公开(公告)日：1988-08-02

    申请号：US765427

    申请日：1985-08-14

    申请人： David M. Webb

    发明人： David M. Webb

    IPC分类号： G06F9/38 ,  G06F9/34

    CPC分类号： G06F9/3802

    摘要： Certain stored program digital computer systems employ a single central memory to which requests are made for individual instruction words stored within it. Certain types of these memories employ address queues in which requests may be temporarily stored when requests come in more rapidly than the central memory can service them. A write valid memory records each central memory request and provides a status signal which can be used to prevent placing of a further request for the word at an address in the queue.

    摘要翻译： 某些存储的程序数字计算机系统使用单个中央存储器，对存储在其中的各个指令字作出请求。 某些类型的这些存储器采用地址队列，其中当请求比中央存储器可以服务它们更快时，可以临时存储请求。 写入有效存储器记录每个中央存储器请求并提供状态信号，该状态信号可用于防止将该字的进一步请求放置在队列中的地址处。

    Multi-group LRU resolver
    18.
    发明授权
    Multi-group LRU resolver 失效
    多组LRU解算器

    公开(公告)号：US4511994A

    公开(公告)日：1985-04-16

    申请号：US424665

    申请日：1982-09-27

    申请人： David M. Webb ,  Thomas A. Lane

    发明人： David M. Webb ,  Thomas A. Lane

    IPC分类号： G06F12/00 ,  G06F12/02 ,  G06F12/12 ,  G06F7/00 ,  G06F7/38

    CPC分类号： G06F12/125

    摘要： A logic system maintains current least recently used information among the elements of each group in a plurality of groups where each group includes two or more elements. A memory stores intermediate information regarding the relative precedence between each combination of elements in a given group. A logic network recomputes this value each time an element in a group is used and provides this new information to the memory and to a network which resolves the current least recently used status.

    摘要翻译： 逻辑系统在多个组中的每个组的元素之间保持当前最近最少使用的信息，其中每个组包括两个或更多个元素。 存储器存储关于给定组中的每个元素组合之间的相对优先级的中间信息。 逻辑网络在每次使用组中的元素时重新计算该值，并将该新信息提供给存储器和解决当前最近最少使用状态的网络。