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公开(公告)号：CN118540248A
公开(公告)日：2024-08-23
申请号：CN202410863391.3
申请日：2024-06-29
Applicant: 中国人民解放军战略支援部队信息工程大学
IPC: H04L43/0852 , H04L43/18 , H04L69/08 , H04L69/18
Abstract: 本发明涉及高速通信技术领域，特别涉及一种支持多种协议的SerDes接口收发时延测量方法及系统，在待测SerDes接口和以太网标准测试仪之间设置协议转换芯片，所述协议转换芯片用于对待测SerDes接口和以太网标准测试仪之间的通信协议进行协议转换；利用以太网标准测试仪测量收发报文中所携带的时间戳，依据收发报文中的时间戳确定SerDes接口收发时延，所述收发报文为发送至待测SerDes接口用于时延测试的以太网报文。本发明利用标准以太网测试仪及可支持以太网、RapidIO、PCIe等多种协议的协议转换芯片来实现对支持以太网、RapidIO、PCIe等多种协议的SerDes接口收发时延进行测量，极大地提高测量效率，保证测量结果的准确性，利用标准测试仪的时间戳功能，测量结果更加权威，便于部署实施。
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公开(公告)号：CN117614613A
公开(公告)日：2024-02-27
申请号：CN202311520197.7
申请日：2023-11-15
Applicant: 中国人民解放军战略支援部队信息工程大学
Abstract: 本发明属于密码算法硬件加速技术领域，特别涉及一种基于向量化计算的MD5加速方法及系统，该方法包括Host端的CPU负责批量MD5计算任务的程序中的数据预处理和配置加速器的指令流；Device端的加速器负责执行向量化并行计算操作，并将结果输出交由Host端的CPU，CPU最终输出哈希值；所述加速器采用向量化体系结构，所采用的指令集为自定义的向量化指令集。该系统包含通用处理器CPU和专用指令加速器。本发明不需要考虑指令集授权问题以及依赖支持向量化指令集的CPU，完成对批量MD5计算任务的向量化加速。
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公开(公告)号：CN117499344A
公开(公告)日：2024-02-02
申请号：CN202311310818.9
申请日：2023-10-10
Applicant: 中国人民解放军战略支援部队信息工程大学
IPC: H04L49/103 , H04L49/253 , H04L49/111 , H04L47/6275
Abstract: 本发明提供一种面向异构协议交换架构的三级调度方法，所述异构协议交换架构包括通过共享缓存结构组成的第一级交换和通过CrossBar矩阵组成的第二级交换，在所述第一级交换中设置有m*n个端口，该m*n个端口均分为n个端口组PG，每个PG内的端口共享输入缓存和输出缓存，PG之间通过第二级交换中的CrossBar矩阵连接，包括：步骤1：在每个PG中，将目的端口相同的队列请求进行合并处理，进而以PG为基本粒度统一输出调度请求；步骤2：设置m个集中调度模块CA，将一个调度周期分为m个时隙，使得在第Ti个时隙由第i个CA处理到各个PG中Pi端口的调度请求；其中，i=0,1,…,m‑1，m表示单个PG中的交换端口数量。本发明基于时隙的多级调度方法实现了对时分空分的完全解耦。
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公开(公告)号：CN117459181A
公开(公告)日：2024-01-26
申请号：CN202311099387.6
申请日：2023-08-29
Applicant: 中国人民解放军战略支援部队信息工程大学
IPC: H04L1/00
Abstract: 本发明提供一种基于因子图与和积算法的联合协议‑信道译码方法。该方法包括：步骤1：针对当前协议栈，分析各层协议中存在的协议自然冗余类型，并将所有的报头字段划分为固定字段、帧间重复字段、帧间顺序递增字段、合法集字段、校验字段和随机字段；步骤2：依据重复冗余、顺序递增冗余各自与LDPC的联合因子图，构建跨帧的LDPC‑重复冗余‑顺序递增冗余联合矩阵HL‑R‑I作为主译码器Decoder 1；步骤3：依据合法集冗余、Checksum冗余和CRC冗余各自与主译码器Decoder 1的联合因子图，分别构建各帧的合法集冗余分支译码器Decoder 2、Checksum冗余分支译码器Decoder 3和CRC冗余分支译码器Decoder4；步骤4：依据构建的各译码器，执行基于和积算法的跨帧跨层联合协议‑信道译码。
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公开(公告)号：CN110430042B
公开(公告)日：2022-11-22
申请号：CN201910573828.9
申请日：2019-06-28
Applicant: 中国人民解放军战略支援部队信息工程大学
Abstract: 本发明涉及异构冗余系统以及加密技术秘钥存储领域，特别涉及一种在异构冗余系统中存储秘钥的装置及方法，该装置包括：秘钥切分模块，用于将一定长度的秘钥切分为m份等长的秘钥块，并为每份秘钥块打上数据标签1,2，…，m；秘钥分配模块，用于按照既定策略，将(k‑1)*m份秘钥块分配给k个秘钥存储单元；秘钥存储模块，用于妥善保存分配给每个秘钥存储单元的n个秘钥块，各个秘钥存储单元分布在不同的异构执行体中；以及秘钥组合模块，用于从秘钥存储单元获取秘钥块，并根据数据标签，将其组合成完整的秘钥。由于将秘钥分段，并存储到不同的秘钥存储单元中，可以在系统出现单点攻破的情况下，不至于丢失全部秘钥，避免给系统通信造成威胁。
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Patent Agency Ranking
公开(公告)号：CN110149242B
公开(公告)日：2021-04-02
申请号：CN201910339183.2
申请日：2019-04-25
Applicant: 中国人民解放军战略支援部队信息工程大学
Abstract: 本发明提供一种支持SRIO与以太网的协议转换功能验证装置及方法。该装置包括：SRIO流量模型设备，用于校验第一以太网协议数据包和第一SRIO协议数据包的一致性；以及以太网流量模型设备，用于校验第二SRIO协议数据包和第二以太网协议数据包的一致性。该方法包括：随机生成若干数据作为payload；按照发送端流量模型侧协议的包格式将payload封装包头信息Header组成第一数据包；将第一数据包发送至目标协议转换芯片，目标协议转换芯片对第一数据包进行协议转换得到第二数据包；将payload备份给接收端流量模型，接收端流量模型根据payload和第二数据包校验目标芯片的协议转换结果。本发明可自动对比payload的双端互联互通，以验证目的协议转换的正确性。
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公开(公告)号：CN112152799A
公开(公告)日：2020-12-29
申请号：CN202010899528.2
申请日：2020-08-31
Applicant: 中国人民解放军战略支援部队信息工程大学
IPC: H04L9/08
Abstract: 本发明提供一种面向多模执行体加密应用的密源归一机制。该密源归一机制包括：调度器接收各个执行体发送的申请密源的请求，所述密源是指影响加密的参数信息；调度器根据请求的密源类型，按照各密源类型对应的密源同步流程向不同的执行体返回相同的密源，以使得各个执行体的加密密文一致。本发明通过分析导致多模执行体加密应用表现不一的原因，设计了密源归一机制，使得多模执行体统一向调度器申请随机值、加密密钥以及字节数等密源信息，将密源归一，使得不同执行体产生的密文表现一致，解决了多模执行体中加密应用表现不一的问题，从而利于调度器进行仲裁判决。
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公开(公告)号：CN111880634A
公开(公告)日：2020-11-03
申请号：CN202010602603.4
申请日：2020-06-29
Applicant: 中国人民解放军战略支援部队信息工程大学
Abstract: 本发明提供一种SRIO交换芯片的复位结构及其复位状态监控方法。该复位结构包括：全局复位模块，所述全局复位模块的输入端连接复位源，其输出端连接交换芯片的复位对象；所述复位源包括外部引脚输入源、端口逻辑的复位请求处理源和全局寄存器配置源；所述复位对象包括：包含核心PLL和分频器的时钟模块，包含SerDes PLL、SerDes数据逻辑和SerDes寄存器的SerDes模块，包含端口逻辑和端口寄存器的端口模块，包含交换逻辑和交换寄存器的核心交换模块，I2C模块，JTAG模块和全局寄存器模块。本发明可以处理多种类型的复位源，每种复位源可以对交换芯片的不同范围进行复位，并且当多个复位源同时有效时，还可以按照复位优先级依次进行复位操作，以保证复位的可靠性。
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公开(公告)号：CN111143122A
公开(公告)日：2020-05-12
申请号：CN201911180775.0
申请日：2019-11-27
Applicant: 中国人民解放军战略支援部队信息工程大学
IPC: G06F11/14 , H04L12/933
Abstract: 本发明提供一种可靠的交换芯片复位结构及其复位方法。该交换芯片复位结构包括：全局复位控制单元、Sdbank复位控制单元和IP模块复位控制单元；全局复位控制单元的输入端连接复位源，其输出端连接Sdbank复位控制单元的输入端和IP模块复位控制单元的输入端；Sdbank复位控制单元的输出端连接IP模块复位控制单元的输入端；全局复位控制单元用于生成整个交换芯片所需的复位信号；Sdbank复位控制单元用于生成BANK内部所需的复位信号；IP模块复位控制单元用于生成各个IP模块所需的复位信号。本发明提供的交换芯片复位结构，按照3级复位结构对交换芯片进行全芯片复位设计，简化了整个交换芯片的复位结构，更有利于芯片的自动化集成。
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公开(公告)号：CN110535788A
公开(公告)日：2019-12-03
申请号：CN201910628079.5
申请日：2019-07-12
Applicant: 中国人民解放军战略支援部队信息工程大学
IPC: H04L12/931
Abstract: 本发明提供了一种多协议控制器和多协议交换芯片，涉及数据传输技术领域，该多协议控制器包括嵌入式现场可编程门阵列模块；该嵌入式现场可编程门阵列模块用于加载待支持协议的部分或全部控制逻辑。本发明实施例提供的多协议控制器和多协议交换芯片，应用嵌入式现场可编程门阵列(EFPGA)实现可编程的硬件控制电路，使得整体控制器可以通过外部加载的方式支持多种不同协议，提高了应用的灵活性；通过专用集成电路(ASIC)实现多协议之间的可复用逻辑，有效节省了电路占用面积，降低了功耗。
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