一种基于SERDES的数据复合时序传输方法

    公开(公告)号:CN114024609B

    公开(公告)日:2023-06-20

    申请号:CN202111333933.9

    申请日:2021-11-11

    摘要: 本发明提供一种基于SERDES的数据复合时序传输方法,包括:发送端和接收端传送相位关系固定的低速时钟,两边该低速时钟相参且有稳定的相位关系;发射端利用低速时钟产生时序;在时序信息的变化沿,在发射的数据流中添加特殊数据段;经过SERDES并串转换、编码、电光转换、光纤传输、光电转换、SERDES串并转换、解码;接收端利用SERDES恢复的高速用户时钟搜索发射数据流中添加的特殊数据段,并送出标记信息;接收端利用低速时钟同步上述标记信息,即获得时序信息。本发明利用收发通道与信号处理之间基于SERDES的点对点的光通信资源,将需要通信的协议信息与需要传输的时序信息进行打包同步传输,从而为系统节省了专用时序传输网络。

    一种分数延时滤波器延时性能测试方法及其测试装置

    公开(公告)号:CN105891701B

    公开(公告)日:2018-09-21

    申请号:CN201610422151.5

    申请日:2016-06-08

    IPC分类号: G01R31/28

    摘要: 本发明公开了一种分数延时滤波器延时性能测试方法及其测试装置。该方法包括:提供相互之间存在一个延时精度值的两路测试信号;将两路测试信号分别送入延时值分别设置为零和延迟精度值的两个待测试分数延时滤波器中,并由此形成两路输出信号;比较两路输出信号:将两路输出信号相减,根据差值情况来判断评估该待测试分数延时滤波器的延时性能,或用将两路输出信号采用相关函数方法来评估;改变延时值为该延时精度值的整数倍数或改变两路测试信号的频率值,再重复以上步骤。本发明还公开应用该方法的分数延时滤波器延时性能测试装置、另一种分数延时滤波器延时性能测试方法及应用这另一种方法的分数延时滤波器延时性能测试装置。

    数字阵列雷达多路模拟通道相对延时测量装置及方法

    公开(公告)号:CN104375132B

    公开(公告)日:2016-09-07

    申请号:CN201410706898.4

    申请日:2014-11-28

    IPC分类号: G01S7/40

    摘要: 本发明公开了数字阵列雷达多路模拟通道相对延时测量装置及方法。该方法包括:采集经过耦合网络的多路模拟通道的多个宽带线性调频信号,并经模拟和数字混频后得到多路基带IQ信号;对多路基带IQ信号从相同的距离段截取相同的点数得到多个相位曲线;用多个相位曲线分别与标准理想的相位曲线相减得到多个相位差Δφ随时间t的变化关系,并拟合直线得到多个斜率k,由此分别得到多路模拟通道的宽带线性调频信号相对于标准理想的宽带线性调频信号的多个延时;用多个延时扣除各自模拟通道耦合网络带来的延时后,再以其中某一路模拟通道的延时作为参考,所有其他路模拟通道的延时分别与作为参考的这路模拟通道的延时相减最终得到各通道之间的相对延时。

    一种数字阵列接收通道群时延起伏的测量方法及系统

    公开(公告)号:CN110351165A

    公开(公告)日:2019-10-18

    申请号:CN201910662002.X

    申请日:2019-07-22

    IPC分类号: H04L12/26 H04B17/364

    摘要: 本发明公开了一种数字阵列接收通道群时延起伏的测量方法及系统,属于数字阵列测控通信技术领域,包括以下步骤:S1:接收宽带线性调频信号;S2:得到多路基带I/Q数据;S3:得到各接收通道的分段相位;S4:得到各接收通道的群时延数据;S5:得到各接收通道的群时延起伏数据。本发明可以直接测量含有变频接收通道和ADC在内的数字阵列接收通道的总群时延起伏,测试结果更具有指导意义;采用了嵌入式测量方法,无需断开链路和引出额外测试端口,可以随时在线测量出群时延起伏指标;可以同时测量出数字阵列所有接收通道的群时延起伏指标,测试效率高;所测得的群时延起伏数据是通过多点拟合得到的,测量精度高。

    一种雷达阵面数字单元程序并行刷新方法

    公开(公告)号:CN105183502B

    公开(公告)日:2018-04-13

    申请号:CN201510493395.8

    申请日:2015-08-12

    IPC分类号: G06F8/65

    摘要: 本发明公开了一种雷达阵面数字单元程序并行刷新方法,雷达阵面数字单元包括通信口、FPGA、非易失性存储器。非易失性存储器划分为三个区间:默认程序区、应用程序区、电子标签区。默认程序区:默认程序只能通过配置电缆加载,主要负责通过通信口对非易失性存储器的读写操作。应用程序区:应用程序加载,雷达阵面数字单元的功能主要在应用程序实现。电子标签区:每个雷达阵面数字单元的特有信息在默认程序或应用程序工作时写入和读取,掉电和重刷程序不会破坏此信息。系统上电后,FPGA启动进入默认程序,在默认程序短暂停留后自动重启进入某一个应用程序或接收通信接口的命令后重启进入某一个应用程序,之后FPGA开始正常工作。

    一种雷达阵面数字单元程序并行刷新方法

    公开(公告)号:CN105183502A

    公开(公告)日:2015-12-23

    申请号:CN201510493395.8

    申请日:2015-08-12

    IPC分类号: G06F9/445

    摘要: 本发明公开了一种雷达阵面数字单元程序并行刷新方法,雷达阵面数字单元包括通信口、FPGA、非易失性存储器。非易失性存储器划分为三个区间:默认程序区、应用程序区、电子标签区。默认程序区:默认程序只能通过配置电缆加载,主要负责通过通信口对非易失性存储器的读写操作。应用程序区:应用程序加载,雷达阵面数字单元的功能主要在应用程序实现。电子标签区:每个雷达阵面数字单元的特有信息在默认程序或应用程序工作时写入和读取,掉电和重刷程序不会破坏此信息。系统上电后,FPGA启动进入默认程序,在默认程序短暂停留后自动重启进入某一个应用程序或接收通信接口的命令后重启进入某一个应用程序,之后FPGA开始正常工作。

    数字阵列雷达多路模拟通道相对延时测量装置及方法

    公开(公告)号:CN104375132A

    公开(公告)日:2015-02-25

    申请号:CN201410706898.4

    申请日:2014-11-28

    IPC分类号: G01S7/40

    CPC分类号: G01S7/4004

    摘要: 本发明公开了数字阵列雷达多路模拟通道相对延时测量装置及方法。该方法包括:采集经过耦合网络的多路模拟通道的多个宽带线性调频信号,并经模拟和数字混频后得到多路基带IQ信号;对多路基带IQ信号从相同的距离段截取相同的点数得到多个相位曲线;用多个相位曲线分别与标准理想的相位曲线相减得到多个相位差随时间t的变化关系,并拟合直线得到多个斜率k,由此分别得到多路模拟通道的宽带线性调频信号相对于标准理想的宽带线性调频信号的多个延时;用多个延时扣除各自模拟通道耦合网络带来的延时后,再以其中某一路模拟通道的延时作为参考,所有其他路模拟通道的延时分别与作为参考的这路模拟通道的延时相减最终得到各通道之间的相对延时。