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公开(公告)号：CN118331023A
公开(公告)日：2024-07-12
申请号：CN202410188573.5
申请日：2024-02-20
Applicant: 浙江至控科技有限公司 , 浙江中控研究院有限公司
Abstract: 本发明公开了一种基于SS I编码器的冗余控制方法及系统，基于SS I编码器的冗余控制系统，包括：第一控制模块、第二控制模块、第一SS I编码器和第二SS I编码器；所述第一控制模块与外部时钟转向电路模块通过SS I接口双向连接以控制不同模式下输入或输出SS I时钟信号，通过所述外部时钟转向电路模块分别与对应SS I编码器通过SS I接口连接，从而接收SS I时钟并分别转发至对应SS I编码器及所述第二控制模块，在接收到所述SS I时钟后，对应SS I编码器分别与所述第一控制模块通过SS I接口连接，从而将SS I数据反馈至所述第一控制模块，增加了系统稳健性，保证控制和测量的可靠性。
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公开(公告)号：CN118018373A
公开(公告)日：2024-05-10
申请号：CN202410134218.X
申请日：2024-01-31
Applicant: 浙江中控研究院有限公司
Abstract: 本发明公开一种基于FPGA的多路HART调制解调器，包括AC‑DC电路，用于将获取的HART模拟量信号转换为数字量方波信号；一FPGA芯片及FPGA芯片内部构建的HART信号解调单元、数据处理单元、HART信号调制单元，所述HART信号解调单元基于获取的数字量方波信号解码成数字信号发送给所述数据处理单元，所述数据处理单元由FPGA内置的ARM构成，所述数据处理单元基于预设程序对所述数字信号进行处理并发送给所述HART信号调制单元，所述HART信号调制单元将所述数字信号转化为数字量方波信号；DC‑AC电路，将数字量方波信号发送给所述HART信号传输介质。利用FPGA内部集成的ARM核、高性能DSP、丰富的基本逻辑单元、大容量SDRAM和BSRAM等资源，在一片FPGA芯片内能够实现8个HART信号的调制和解调。
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公开(公告)号：CN114465984A
公开(公告)日：2022-05-10
申请号：CN202210376663.8
申请日：2022-04-12
Applicant: 浙江中控研究院有限公司
IPC: H04L61/5007 , H04L61/5053 , H04L61/5076
Abstract: 本发明提供了一种基于传输路径的地址分配方法、系统、设备和计算机可读存储介质。通过本申请提出的技术方案，能够根据控制网络中各个装置与地址分配服务端之间经过的交换机的分布情况，获取装置到地址分配服务端之间的路径信息，并根据这些路径信息为每一个路径确定的装置进行确定且唯一的地址分配。在上述地址分配的过程中无需参考时间间隔或是对装置的分布数量进行预先的获取，技术方案实现较为便捷，能够有效降低地址分配过程中的不确定性，进而提升了控制系统的整体可靠性，适用范围广泛，具有可推广价值。
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公开(公告)号：CN115826479A
公开(公告)日：2023-03-21
申请号：CN202310119544.9
申请日：2023-02-16
Applicant: 浙江中控研究院有限公司
IPC: G05B19/042
Abstract: 本发明公开了一种支持SSI信号采集的PLC系统，包括：通过对外连接器与外部设备连接的SSI电路，通过总线连接器与所述PLC系统内的主控模块连接的控制模块，所述控制模块通过隔离电路与所述SSI电路信号连接；所述控制模块包括FPGA芯片、第一存储器和第二存储器，所述第一存储器内存储有固件程序，所述第二存储器内存储有所述主控模块配置的参数，所述FPGA芯片基于所述主控模块配置的参数和所述固件程序运行以实现采集外部设备的SSI信号。该支持SSI信号采集的PLC系统能够简单、有效的适配目前市面上SSI接口编码器或传感器，无需信号转换模块，上位机可直接通过PLC读取通过SSI信号传输的数据。
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公开(公告)号：CN114816239A
公开(公告)日：2022-07-29
申请号：CN202210267975.5
申请日：2022-03-18
Applicant: 浙江中控研究院有限公司
IPC: G06F3/06 , G06F1/28 , G06F1/30 , G06F1/3234 , G06F1/3287
Abstract: 本发明公开了一种数据掉电保存系统及方法，系统包括：数据传输模块，用于在外部电源正常供电的情况下，进行待存储数据的传输；数据存储模块，用于在外部电源正常供电的情况下，接收所述待存储数据并将所述待存储数据存储于所述数据存储模块的随机存取存储器中；掉电检测模块，用于对所述外部电源的供电情况进行检测，并在所述外部电源掉电的情况下，向所述数据传输模块和所述数据存储模块发送掉电中断信号；供能模块，用于在所述外部电源出现掉电的情况下，为所述数据传输模块的数据传输操作和所述数据存储模块的数据转存操作进行供能。掉电后，将系统数据保存不会因掉电丢失，存储电路仅用单一芯片即可完成掉电保存功能，降低掉电存储的电路功耗。
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Patent Agency Ranking
公开(公告)号：CN114422294B
公开(公告)日：2023-12-01
申请号：CN202210172069.7
申请日：2022-02-24
Applicant: 浙江中控研究院有限公司
Abstract: 本发明公开了一种FlexRay总线与BLVDS总线之间数据交互的装置，针对现有的FlexRay总线与BLVDS总线之间数据不能互联交互的问题，通过FlexRay接口电路连接FlexRay总线，接收FlexRay总线数据并传输至主控处理电路；主控处理电路中的第一数据处理电路将FlexRay总线数据处理成BLVDS数据并传输至BLVDS接口电路；BLVDS接口电路连接BLVDS总线，将BLVDS数据传输至BLVDS总线，实现FlexRay总线至BLVDS总线的数据传输；当数据从BLVDS总线向FlexRay总线传送时，主控处理电路中的第二数据处理电路接收BLVDS接口电路传输的BLVDS总线数据，将BLVDS总线数据处理成FlexRay协议数据并传输至FlexRay接口电路，进而发送至FlexRay总线，实现BLVDS总线至FlexRay总线的数据传输，达到
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公开(公告)号：CN116360383A
公开(公告)日：2023-06-30
申请号：CN202211632229.8
申请日：2022-12-19
Applicant: 浙江中控研究院有限公司
IPC: G05B23/02
Abstract: 本发明公开了一种具备自诊断功能的双向数字量输入装置，包括：开关量输入电路和开关量诊断电路，开关量诊断电路包括整流桥、激励控制单元、分压限流单元、功率放大电路、第一隔离单元和第二隔离单元，整流桥、激励控制单元、分压限流单元、功率放大电路、第一隔离单元和第二隔离单元连接，用于通过控制开关实现内外部激励的切入与屏蔽；开关量输入电路包括一电阻和一开关，开关的两端分别与电阻的两端连接并接入开关量诊断电路；且电路还包括第一输入触点、第二输入触点、第三输入触点、至少一个开关量信号输入通道、至少一个断线检测通道；解决了现有数字量输入电路检测电路复杂，覆盖面小的缺点；实现了自动化控制领域国产自主可控的要求。
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公开(公告)号：CN114465984B
公开(公告)日：2022-08-23
申请号：CN202210376663.8
申请日：2022-04-12
Applicant: 浙江中控研究院有限公司
IPC: H04L61/5007 , H04L61/5053 , H04L61/5076
Abstract: 本发明提供了一种基于传输路径的地址分配方法、系统、设备和计算机可读存储介质。通过本申请提出的技术方案，能够根据控制网络中各个装置与地址分配服务端之间经过的交换机的分布情况，获取装置到地址分配服务端之间的路径信息，并根据这些路径信息为每一个路径确定的装置进行确定且唯一的地址分配。在上述地址分配的过程中无需参考时间间隔或是对装置的分布数量进行预先的获取，技术方案实现较为便捷，能够有效降低地址分配过程中的不确定性，进而提升了控制系统的整体可靠性，适用范围广泛，具有可推广价值。
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公开(公告)号：CN114422294A
公开(公告)日：2022-04-29
申请号：CN202210172069.7
申请日：2022-02-24
Applicant: 浙江中控研究院有限公司
Abstract: 本发明公开了一种FlexRay总线与BLVDS总线之间数据交互的装置，针对现有的FlexRay总线与BLVDS总线之间数据不能互联交互的问题，通过FlexRay接口电路连接FlexRay总线，接收FlexRay总线数据并传输至主控处理电路；主控处理电路中的第一数据处理电路将FlexRay总线数据处理成BLVDS数据并传输至BLVDS接口电路；BLVDS接口电路连接BLVDS总线，将BLVDS数据传输至BLVDS总线，实现FlexRay总线至BLVDS总线的数据传输；当数据从BLVDS总线向FlexRay总线传送时，主控处理电路中的第二数据处理电路接收BLVDS接口电路传输的BLVDS总线数据，将BLVDS总线数据处理成FlexRay协议数据并传输至FlexRay接口电路，进而发送至FlexRay总线，实现BLVDS总线至FlexRay总线的数据传输，达到FlexRay总线与BLVDS总线之间数据交互的目的。
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