浮动输入检测
    1.
    发明授权

    公开(公告)号:CN111788775B

    公开(公告)日:2024-05-14

    申请号:CN201980016209.8

    申请日:2019-03-28

    IPC分类号: H03K5/19 H03M1/66

    摘要: 一种用于检测浮动信号输入端子的方法包括:向耦合至信号输入端子(234)的第一放大器(204)提供共模输入电压,以及将由第一放大器(204)生成的输出信号(230)提供给:耦合至信号输入端子(234)的第二放大器(202)的同相输入端(222)、第二放大器(202)的反相输入端(220)、粗略检测电路系统和精细浮动检测电路系统。该方法还包括由粗略检测电路系统将输出信号(230)与第一阈值电压进行比较,以及响应于该比较指示输出信号(230)大于第一阈值电压来确定信号输入端子(234)未浮动。

    一种捕获电路、微处理芯片及设备

    公开(公告)号:CN116455365B

    公开(公告)日:2024-02-09

    申请号:CN202310442512.2

    申请日:2023-04-21

    IPC分类号: H03K5/19 H03K23/40

    摘要: 本申请实施例提供一种捕获电路、微处理芯片及设备,包括:第一计数支路,用于获取同步信号,对采样时钟信号进行计数得到计数信息,在检测到沿信号时,存储计数信息;第二计数支路的第一输入端与第一计数支路的第一输出端连接,第二计数支路,用于对沿信号进行时间捕获,得到时间信息;编码模块的输入端与第二计数支路的第一输出端连接,第一输出端与数据处理模块的控制端连接;编码模块,用于在时间捕获时输出第一使能信号;数据处理模块的第一输入端与第一计数支路的第二输出端连接,第二输入端与第二计数支路的第二输出端连接;数据处理模块,用于在接收到第一使能信号时,获取对采样时钟信号的计数信息,并获取捕获的所述时间信息。

    延迟锁相环路时钟信号占空比检测方法、占空比检测器

    公开(公告)号:CN116614114B

    公开(公告)日:2023-12-19

    申请号:CN202310392614.8

    申请日:2023-04-13

    摘要: 本发明公开了一种延迟锁相环路时钟信号占空比检测方法、占空比检测器,该方法配置由可调延迟单元构成的环状振荡器,可调延迟单元组合对可变时钟信号进行响应,以改变环状振荡器输出的振荡器时钟信号的周期;再配置两路环状振荡器,分别由时钟信号和时钟信号的反信号控制;配置两路计数器结构,计数器以振荡器时钟信号为触发信号计数;在预设时间周期内,控制比较两所述计数器结构的计数,并将比较结果发送至控制器的步骤,采用计数器计数方式,取代现有技术下通过电容预充电后放电的方式,用数字方式对时钟信号占空比进行快速准确的检测,同时,由于减少了芯片版图中使用的器件个

    延迟锁相环路时钟信号占空比检测方法、占空比检测器

    公开(公告)号:CN116614114A

    公开(公告)日:2023-08-18

    申请号:CN202310392614.8

    申请日:2023-04-13

    摘要: 本发明公开了一种延迟锁相环路时钟信号占空比检测方法、占空比检测器,该方法配置由可调延迟单元构成的环状振荡器,可调延迟单元组合对可变时钟信号进行响应,以改变环状振荡器输出的振荡器时钟信号的周期;再配置两路环状振荡器,分别由时钟信号和时钟信号的反信号控制;配置两路计数器结构,计数器以振荡器时钟信号为触发信号计数;在预设时间周期内,控制比较两所述计数器结构的计数,并将比较结果发送至控制器的步骤,采用计数器计数方式,取代现有技术下通过电容预充电后放电的方式,用数字方式对时钟信号占空比进行快速准确的检测,同时,由于减少了芯片版图中使用的器件个数,显著缩小了版图面积,简化了占空比检测电路的复杂度。

    时钟信号监测电路及方法
    6.
    发明公开

    公开(公告)号:CN115021727A

    公开(公告)日:2022-09-06

    申请号:CN202210757763.5

    申请日:2022-06-30

    IPC分类号: H03K5/19 G06F1/14

    摘要: 本申请涉及一种时钟信号监测电路及方法。所述的电路包括:同步电路,用于将所述系统时钟的时钟域信号同步到参考时钟的时钟域并生成同步信号;计数器电路,与所述同步电路电连接,用于根据计数开始信号开始计数直至预设阈值并生成错误采样信号;复位同步电路,与所述计数器电路电连接,用于根据所述系统时钟生成时钟有效标志;错误标志产生电路,与所述复位同步电路及所述计数器电路均电连接,用于根据所述错误采样信号及时钟错误信号生成时钟丢失信号;其中,所述时钟错误信号为所述时钟有效标志的取反信号,所述系统根据所述时钟丢失信号做出预设报警动作。采用本电路能够实现时钟丢失检测,避免由于电路系统使用的时钟丢失而不能维持系统操作。

    一种数字电压输出电路
    7.
    发明公开

    公开(公告)号:CN114268306A

    公开(公告)日:2022-04-01

    申请号:CN202111444790.9

    申请日:2021-11-30

    摘要: 本发明提供了一种数字电压输出电路,涉及电路设计的技术领域,包括:电源监视电路、脉冲驱动电路、隔离输出电路、中央处理器以及接口防护电路;中央处理分别与电源监视电路以及脉冲驱动电路相连;隔离输出电路分别与脉冲驱动电路以及电源监视电路相连;隔离输出电路与接口防护电路相连。通过本发明的电路可以缓解现有技术中数字电路可靠性差、输出容易发生错误、不易监测的技术问题,提高数字电路的可靠性。

    周期信号的参数确定方法及电子设备

    公开(公告)号:CN111756357A

    公开(公告)日:2020-10-09

    申请号:CN202010550254.6

    申请日:2020-06-16

    发明人: 于龙 李春雨 刘鹏

    IPC分类号: H03K5/19

    摘要: 本发明实施例适用于信号测量技术领域,提供了一种周期信号的参数确定方法及电子设备,其中,周期信号的参数确定方法包括:接收外部周期信号;确定设定精度对应的所述锁相环的配置参数;在所述设定精度位于第一设定范围的情况下,将外部周期信号分别输入延时模块和所述触发器,得到触发器的输出信号;延时模块中的每一级延时器分别向下一级延时器和所述触发器发送延迟信号;所述触发器根据外部周期信号或延迟信号生成输出信号;基于所述输出信号、所述延时器对应的延迟时间和第一时钟信号确定所述外部周期信号的参数;第一时钟信号由锁相环基于设定精度对应的配置参数和时钟模块提供的基准时钟信号生成。

    容错时钟监视器系统
    10.
    发明公开

    公开(公告)号:CN110999086A

    公开(公告)日:2020-04-10

    申请号:CN201880054301.9

    申请日:2018-10-12

    IPC分类号: H03K5/19

    摘要: 本发明提供了一种时钟监视器,该时钟监视器包括作为参考时钟输入的测试时钟输入、另一时钟输入、测量电路和控制逻辑部件。测量电路使用参考时钟输入来生成测试时钟输入的频率或占空比的测量,并且将其与阈值进行比较。控制逻辑部件确定测量是否超过阈值,并且基于测量超过阈值,使得使用第三时钟输入结合第一时钟输入或参考时钟输入来生成频率或占空比的另一测量。控制逻辑部件可以确定其他测量是否超过阈值,并且基于此类确定,进一步确定测试时钟输入或参考时钟输入有故障。