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    DIGITAL PHASE LOCKED LOOP
    3.
    发明申请
    DIGITAL PHASE LOCKED LOOP 有权
    数字相位锁定环

    公开(公告)号：US20080116982A1

    公开(公告)日：2008-05-22

    申请号：US11939894

    申请日：2007-11-14

    申请人： Robertus Laurentius van der Valk ,  Paulus Hendricus Lodewijk Maria Schram ,  Johannes Hermanus Aloysius de Rijk

    发明人： Robertus Laurentius van der Valk ,  Paulus Hendricus Lodewijk Maria Schram ,  Johannes Hermanus Aloysius de Rijk

    IPC分类号： H03L7/085 ,  H03L7/08

    CPC分类号： H03L7/0991 ,  H03L7/085 ,  H03L7/091 ,  H03L7/18 ,  H03L2207/50

    摘要： A digital phase locked loop includes a phase acquisition unit for producing a digital representation of the phase of a reference signal, a digital phase detector having a first input receiving a digital signal from, or derived from, the output of the phase acquisition unit, digital loop filter filtering the output of the digital phase detector, and a digital controlled oscillator generating an output signal under the control of the digital loop filter. A digital feedback loop provides a second input to the digital phase detector from the output of the digital controlled oscillator.

    摘要翻译： 数字锁相环包括用于产生参考信号的相位的数字表示的相位获取单元，具有从相位获取单元的输出接收数字信号或从相位获取单元的输出导出的数字相位检测器的数字相位检测器，数字 环路滤波器对数字相位检测器的输出进行滤波，数字控制振荡器在数字环路滤波器的控制下产生输出信号。 数字反馈环路从数字控制振荡器的输出端向数字相位检测器提供第二输入。