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公开(公告)号:CN113439265A
公开(公告)日:2021-09-24
申请号:CN202080011299.4
申请日:2020-03-14
申请人: 英特尔公司
发明人: A·考克 , J·雷 , A·阿南塔拉曼 , V·安德烈 , A·阿普 , S·科尔曼 , N·加洛泊凡博列斯 , V·乔治 , P·开 , S·金 , M·麦克弗森 , S·马余兰 , E·乌尔德-阿迈德-瓦尔 , V·兰加纳坦 , J·瓦莱里奥
IPC分类号: G06F12/0811
摘要: 本文公开了用于更新多GPU配置中的远程存储器侧高速缓存的系统和方法。在一个实施例中,用于多片架构的图形处理器包括:第一图形处理单元(GPU)(2810),该第一GPU具有第一存储器(2870‑1)、第一存储器侧高速缓存存储器(2880‑1)、第一通信结构(2860‑1)和第一存储器管理单元(MMU)(2855‑1)。图形处理器包括第二GPU(2820),该第二GPU具有第二存储器(2870‑2)、第二存储器侧高速缓存存储器(2880‑2)、第二MMU(2855‑2)和第二通信结构(2860‑2),第二通信结构通信地耦合至第一通信结构。第一MMU配置成用于控制对第一存储器的存储器请求,更新第一存储器中的内容,更新第一存储器侧高速缓存存储器中的内容,并且确定是否更新第二存储器侧高速缓存存储器中的内容。
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公开(公告)号:CN113366454A
公开(公告)日:2021-09-07
申请号:CN202080011597.3
申请日:2020-03-14
申请人: 英特尔公司
发明人: A·考克 , B·阿什博 , S·贾纳斯 , A·阿南塔拉曼 , A·R·阿普 , N·库雷 , V·乔治 , A·亨特 , B·英斯科 , E·乌尔德-阿迈德-瓦尔 , S·潘尼尔 , V·兰加纳坦 , J·雷 , K·辛哈 , L·斯特里拉马萨尔玛 , P·萨蒂 , S·唐格里
IPC分类号: G06F12/0804 , G06F12/0893 , G06F15/173
摘要: 实施例总体上涉及用于图形操作的多片架构。装置的实施例包括:用于图形操作的多片架构,包括多片图形处理器,多片处理器包括:一个或多个管芯;多个处理器片,安装在一个或多个管芯上;以及结构,用于互连一个或多个管芯上的处理器片,其中,结构用于启用多个处理器片中的处理器片之间的通信。
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公开(公告)号:CN113366435A
公开(公告)日:2021-09-07
申请号:CN202080011341.2
申请日:2020-03-14
申请人: 英特尔公司
发明人: A·R·阿普 , A·考克 , A·阿南塔拉曼 , E·乌尔德-阿迈德-瓦尔 , J·雷 , M·麦克弗森 , V·安德烈 , N·加洛泊凡博列斯 , V·乔治 , S·马余兰 , V·兰加纳坦 , J·P·艾斯 , P·开 , S·卡玛
IPC分类号: G06F9/30
摘要: 涉及用于数据压缩的技术的方法和装置。在示例中,装置包括处理器,该处理器用于:接收针对存储器段的数据压缩指令;以及响应于数据压缩指令,响应于确定相同存储器值的序列具有超过阈值的长度而对相同存储器值的序列进行压缩。还公开并要求保护其他实施例。
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公开(公告)号:CN115861022A
公开(公告)日:2023-03-28
申请号:CN202211019025.7
申请日:2022-08-24
申请人: 英特尔公司
摘要: 一个实施例提供一种图形处理器,该图形处理器包括:包含寄存器堆的处理资源,存储器,缓存,和用于处理来自处理资源的加载、存储和预取消息的加载/存储/缓存电路。电路将会将接收到的存储器访问消息排序到读取和写入的地址排序列表中。电路从第一请求缓冲器调度第一组地址排序请求达第一时间段,随后从第二请求缓冲器调度第二组地址排序请求达第二时间段。
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公开(公告)号:CN113409434A
公开(公告)日:2021-09-17
申请号:CN202011527034.8
申请日:2020-12-22
申请人: 英特尔公司
摘要: 用于堆栈节流的设备和方法。例如,一种设备的实施例包括:执行电路,所述执行电路包括多个功能单元,所述多个功能单元用来执行多个光线着色器并生成多个初级光线和对应的多个光线消息;先进先出(FIFO)缓冲器,用来对由所述EU生成的所述光线消息进行排队;高速缓存,用来存储所述多个初级光线中的一个或多个初级光线;存储器支持的堆栈,用来将所述多个光线消息的第一子集存储在对应的多个条目中;存储器支持的堆栈管理电路,用来至少部分地基于在所述存储器支持的堆栈中由光线消息当前占据的条目的数量,将所述多个光线消息的第二子集存储到所述存储器支持的堆栈,或者将所述多个光线消息的一个或多个所述第二子集临时存储到存储器子系统;以及光线遍历电路,用来从所述存储器支持的堆栈读取下一光线消息、从所述高速缓存或存储器子系统检索由所述光线消息标识的下一初级光线、以及对所述下一初级光线执行遍历操作。
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公开(公告)号:CN113383310A
公开(公告)日:2021-09-10
申请号:CN202080014231.1
申请日:2020-03-14
申请人: 英特尔公司
发明人: P·苏尔蒂 , S·迈于兰 , V·安德烈 , A·阿普 , V·乔治 , A·科克 , M·麦克费森 , E·乌尔-艾哈迈德-瓦尔 , V·兰加纳坦 , J·雷 , L·斯特里拉马萨玛 , S·金
IPC分类号: G06F9/30
摘要: 本文描述的实施例包括提供经由脉动处理单元对稀疏数据执行算术的技术的软件、固件和硬件逻辑。一个实施例提供了在使用稀疏数据时优化对脉动阵列的训练和推理的技术。一个实施例提供了在执行稀疏计算操作时使用解压缩信息的技术。一个实施例能够实现经由共享寄存器堆的特殊功能计算阵列的分解。一个实施例能够实现GPGPU上的打包数据压缩和扩展操作。一个实施例提供了利用GPGPU的高速缓存层级内的块稀疏性的技术。
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公开(公告)号:CN113366437A
公开(公告)日:2021-09-07
申请号:CN202080011587.X
申请日:2020-03-14
申请人: 英特尔公司
发明人: A·考克 , J·雷 , B·阿什博 , J·皮尔斯 , A·阿普 , V·兰加纳坦 , L·斯特里拉马萨尔玛 , E·乌尔德-阿迈德-瓦尔 , A·阿南塔拉曼 , V·安德烈 , N·加洛泊凡博列斯 , V·乔治 , Y·哈雷尔 , 小亚瑟·亨特 , B·英斯科 , S·贾纳斯 , P·开 , M·麦克弗森 , S·马余兰 , M·A·彼得 , M·拉马多斯 , S·沙阿 , K·辛哈 , P·萨蒂 , V·维姆拉帕利
IPC分类号: G06F9/30 , G06F9/38 , G06F12/0811 , G06F12/0862 , G06F12/0866
摘要: 公开了用于提高高速缓存效率和利用率的系统和方法。在一个实施例中,图形处理器包括:处理资源,用于执行图形操作;以及高速缓存的高速缓存控制器,高速缓存耦合至处理资源。高速缓存控制器配置为通过确定默认设置还是指令将控制高速缓存的高速缓存操作来控制高速缓存优先级。
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公开(公告)号:CN112950449A
公开(公告)日:2021-06-11
申请号:CN202011024727.5
申请日:2020-09-25
申请人: 英特尔公司
摘要: 经由掩膜累积提高分层深度缓冲器剔除效率本文中描述的实施例提供了一种用于改进粗略深度测试的剔除效率的技术。一个实施例提供了一种图形处理器,该图形处理器包含深度流水线,该深度流水线被配置成执行一种跟踪针对目的地贴片测试的源片段的历史的方法。当部分片段的组合总计到完全覆盖时,使用最保守的源远深度值,而不是先前的目的地远深度值。
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公开(公告)号:CN112819682A
公开(公告)日:2021-05-18
申请号:CN202011282679.X
申请日:2020-11-13
申请人: 英特尔公司
摘要: 本文描述的实施例提供了指令和相关联的逻辑,以使包括张量加速器的处理资源能够执行稀疏子矩阵运算的优化计算。一个实施例提供了用于将数值变换应用于矩阵数据以增加数据稀疏性的硬件逻辑。当压缩矩阵数据时,增加稀疏性可以得到较高的压缩率。
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公开(公告)号:CN117689531A
公开(公告)日:2024-03-12
申请号:CN202311777921.4
申请日:2020-03-14
申请人: 英特尔公司
发明人: A·考克 , J·雷 , A·阿南塔拉曼 , V·安德烈 , A·阿普 , S·科尔曼 , N·加洛泊凡博列斯 , V·乔治 , P·开 , S·金 , M·麦克弗森 , S·马余兰 , E·乌尔德-阿迈德-瓦尔 , V·兰加纳坦 , J·瓦莱里奥
IPC分类号: G06T1/20 , G06T1/60 , G06F12/0877
摘要: 本文公开了用于更新多GPU配置中的远程存储器侧高速缓存的系统和方法。在一个实施例中,用于多片架构的图形处理器包括:第一图形处理单元(GPU)(2810),该第一GPU具有第一存储器(2870‑1)、第一存储器侧高速缓存存储器(2880‑1)、第一通信结构(2860‑1)和第一存储器管理单元(MMU)(2855‑1)。图形处理器包括第二GPU(2820),该第二GPU具有第二存储器(2870‑2)、第二存储器侧高速缓存存储器(2880‑2)、第二MMU(2855‑2)和第二通信结构(2860‑2),第二通信结构通信地耦合至第一通信结构。第一MMU配置成用于控制对第一存储器的存储器请求,更新第一存储器中的内容,更新第一存储器侧高速缓存存储器中的内容,并且确定是否更新第二存储器侧高速缓存存储器中的内容。
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