公开(公告)号：US20060095668A1

公开(公告)日：2006-05-04

申请号：US10976260

申请日：2004-10-28

申请人： Michael Day ,  Charles Johns ,  Thuong Truong

发明人： Michael Day ,  Charles Johns ,  Thuong Truong

IPC分类号： G06F12/14

CPC分类号： G06F12/126 ,  G06F12/0848 ,  G06F2212/2515

摘要： The present invention provides a method for a processor to write data to a cache or other fast memory, without also writing it to main memory. Further, the data is “locked” into the cache or other fast memory until it is loaded for use. Data remains in the locking cache until it is specifically overwritten under software control. The locking cache or other fast memory can be used as additional system memory. In an embodiment of the invention, the locking cache is one or more sets of ways, but not all of the sets or ways, of a multiple set associative cache.

摘要翻译： 本发明提供了一种用于处理器将数据写入高速缓存或其他快速存储器的方法，而不将其写入主存储器。 此外，数据被“锁定”到高速缓存或其他快速存储器中，直到它被加载使用为止。 数据保留在锁定缓存中，直到它在软件控制下被特别覆盖为止。 锁定缓存或其他快速存储器可用作附加系统内存。 在本发明的实施例中，锁定高速缓存是多组关联高速缓存的一组或多组方式，但不是所有的集合或方式。

公开(公告)号：US20050160229A1

公开(公告)日：2005-07-21

申请号：US10759941

申请日：2004-01-16

申请人： Charles Johns ,  Michael Day ,  Jonathan DeMent

发明人： Charles Johns ,  Michael Day ,  Jonathan DeMent

IPC分类号： G06F12/08 ,  G06F12/10

CPC分类号： G06F12/1027 ,  G06F2212/654 ,  G06F2212/684

摘要： A method and an apparatus are provided for efficiently managing the operation of a translation buffer. A software and hardware apparatus and method are utilized to pre-load a translation buffer to prevent poor operation as a result of slow warming of a cache.

摘要翻译： 提供了一种用于有效地管理翻译缓冲器的操作的方法和装置。 使用软件和硬件装置和方法来预加载翻译缓冲器，以防止由于缓存缓慢升温而造成的不良操作。

公开(公告)号：US20050138325A1

公开(公告)日：2005-06-23

申请号：US11050038

申请日：2005-02-03

申请人： Harm Hofstee ,  Charles Johns ,  James Kahle

发明人： Harm Hofstee ,  Charles Johns ,  James Kahle

IPC分类号： G06F15/16 ,  G06F9/44 ,  G06F9/50 ,  G06F15/177 ,  G06F15/80 ,  H04L29/06 ,  H04L29/08 ,  G06F15/00 ,  G06F15/173

CPC分类号： G06F9/4862 ,  G06F15/16 ,  H04L29/06027 ,  H04L63/168 ,  H04L67/10 ,  H04L67/34

摘要： A computer architecture and programming model for high speed processing over broadband networks are provided. The architecture employs a consistent modular structure, a common computing module and uniform software cells. The common computing module includes a control processor, a plurality of processing units, a plurality of local memories from which the processing units process programs, a direct memory access controller and a shared main memory. A synchronized system and method for the coordinated reading and writing of data to and from the shared main memory by the processing units also are provided. A hardware sandbox structure is provided for security against the corruption of data among the programs being processed by the processing units. The uniform software cells contain both data and applications and are structured for processing by any of the processors of the network. Each software cell is uniquely identified on the network.

摘要翻译： 提供了一种用于宽带网络高速处理的计算机体系结构和编程模型。 该架构采用一致的模块化结构，通用的计算模块和统一的软件单元。 公共计算模块包括控制处理器，多个处理单元，处理单元处理程序的多个本地存储器，直接存储器存取控制器和共享主存储器。 还提供了一种用于由处理单元协调地读取和从共享主存储器写入数据的同步系统和方法。 提供了一种硬件沙盒结构，用于防止由处理单元处理的程序中的数据损坏的安全性。 统一软件单元包含数据和应用程序，并且被构造为由网络的任何处理器进行处理。 每个软件单元在网络上唯一标识。

公开(公告)号：US20080040549A1

公开(公告)日：2008-02-14

申请号：US11875407

申请日：2007-10-19

申请人： Michael Day ,  Charles Johns ,  Thuong Truong

发明人： Michael Day ,  Charles Johns ,  Thuong Truong

IPC分类号： G06F12/08 ,  G06F12/14

CPC分类号： G06F12/0848 ,  G06F12/0875

摘要： The present invention provides a method of storing data transferred from an I/O device, a network, or a disk into a portion of a cache or other fast memory, without also writing it to main memory. Further, the data is “locked” into the cache or other fast memory until it is loaded for use. Data remains in the locking cache until it is specifically overwritten under software control. In an embodiment of the invention, a processor can write data to the cache or other fast memory without also writing it to main memory. The portion of the cache or other fast memory can be used as additional system memory.

摘要翻译： 本发明提供一种将从I / O设备，网络或盘传送的数据存储到高速缓存或其他快速存储器的一部分中的方法，而不将其写入主存储器。 此外，数据被“锁定”到高速缓存或其他快速存储器中，直到它被加载使用为止。 数据保留在锁定缓存中，直到它在软件控制下被特别覆盖为止。 在本发明的一个实施例中，处理器可以将数据写入高速缓存或其它快速存储器，而不将其写入主存储器。 高速缓存或其他快速存储器的部分可以用作额外的系统存储器。

公开(公告)号：US20080040548A1

公开(公告)日：2008-02-14

申请号：US11874513

申请日：2007-10-18

申请人： Michael Day ,  Charles Johns ,  Thuong Truong

发明人： Michael Day ,  Charles Johns ,  Thuong Truong

IPC分类号： G06F12/02

CPC分类号： G06F12/126 ,  G06F12/0848 ,  G06F2212/2515

摘要： The present invention provides a method for a processor to write data to a cache or other fast memory, without also writing it to main memory. Further, the data is “locked” into the cache or other fast memory until it is loaded for use. Data remains in the locking cache until it is specifically overwritten under software control. The locking cache or other fast memory can be used as additional system memory. In an embodiment of the invention, the locking cache is one or more sets of ways, but not all of the sets or ways, of a multiple set associative cache.

摘要翻译： 本发明提供了一种用于处理器将数据写入高速缓存或其他快速存储器的方法，而不将其写入主存储器。 此外，数据被“锁定”到高速缓存或其他快速存储器中，直到它被加载使用为止。 数据保留在锁定缓存中，直到它在软件控制下被特别覆盖为止。 锁定缓存或其他快速存储器可用作附加系统内存。 在本发明的实施例中，锁定高速缓存是多组关联高速缓存的一组或多组方式，但不是所有的集合或方式。

公开(公告)号：US20070288701A1

公开(公告)日：2007-12-13

申请号：US11841852

申请日：2007-08-20

申请人： Harm Hofstee ,  Charles Johns ,  James Kahle

发明人： Harm Hofstee ,  Charles Johns ,  James Kahle

IPC分类号： G06F13/00

CPC分类号： G06F9/4862 ,  G06F15/16 ,  H04L29/06027 ,  H04L63/168 ,  H04L67/10 ,  H04L67/34

摘要： A system for using a plurality of heterogeneous processors in a common computer system is presented. Each processor type in the heterogeneous group handles a particular instruction set. The processors share a common memory using a common bus. In one embodiment, one of the processor types accesses the memory using DMA instructions. In another embodiment, a cache for each type of processor is stored in the common memory pool. In one embodiment, one or more PowerPC processors shares a memory with one or more Synergistic Processing Complex (SPC). A common table is used to track and maintain memory for the various processors.

摘要翻译： 提出了一种在普通计算机系统中使用多个异构处理器的系统。 异构组中的每个处理器类型处理特定的指令集。 处理器使用公共总线共享共享内存。 在一个实施例中，处理器类型之一使用DMA指令访问存储器。 在另一个实施例中，用于每种类型的处理器的高速缓存存储在公共存储器池中。 在一个实施例中，一个或多个PowerPC处理器与一个或多个协同处理复合体（SPC）共享存储器。 通用表用于跟踪和维护各种处理器的内存。

公开(公告)号：US20070174411A1

公开(公告)日：2007-07-26

申请号：US11340453

申请日：2006-01-26

申请人： Daniel Brokenshire ,  Charles Johns ,  Mark Nutter ,  Barry Minor

发明人： Daniel Brokenshire ,  Charles Johns ,  Mark Nutter ,  Barry Minor

IPC分类号： G06F15/167

CPC分类号： G06F15/17337

摘要： An apparatus and method for efficient communication of producer/consumer buffer status are provided. With the apparatus and method, devices in a data processing system notify each other of updates to head and tail pointers of a shared buffer region when the devices perform operations on the shared buffer region using signal notification channels of the devices. Thus, when a producer device that produces data to the shared buffer region writes data to the shared buffer region, an update to the head pointer is written to a signal notification channel of a consumer device. When a consumer device reads data from the shared buffer region, the consumer device writes a tail pointer update to a signal notification channel of the producer device. In addition, channels may operate in a blocking mode so that the corresponding device is kept in a low power state until an update is received over the channel.

摘要翻译： 提供了用于生产者/消费者缓冲器状态的有效通信的装置和方法。 利用该设备和方法，当设备使用设备的信号通知通道在共享缓冲区域上执行操作时，数据处理系统中的设备通知彼此对共享缓冲区域的头和尾指针的更新。 因此，当向共享缓冲区域产生数据的生成器设备将数据写入到共享缓冲区域时，对头指针的更新被写入消费者设备的信号通知通道。 当消费者设备从共享缓冲区域读取数据时，消费者设备将尾指针更新写入生成器设备的信号通知通道。 此外，信道可以以阻塞模式操作，使得对应的设备保持在低功率状态，直到通过信道接收到更新。

公开(公告)号：US20070124618A1

公开(公告)日：2007-05-31

申请号：US11289090

申请日：2005-11-29

申请人： Maximino Aguilar ,  Charles Johns ,  Mark Nutter ,  James Stafford

发明人： Maximino Aguilar ,  Charles Johns ,  Mark Nutter ,  James Stafford

IPC分类号： G06F1/00 ,  G05B13/02

CPC分类号： G06F1/206 ,  G06F1/3203 ,  Y02D10/16 ,  Y02D10/24

摘要： A computer implemented method, data processing system, and computer usable code are provided for using software and hardware thermal profiles to schedule the execution of applications. Hardware and software thermal profiles are generated for a set of processors and a set of applications, respectively, to form a plurality of hardware and software thermal profiles. Then a set of hardware and software thermal profiles are selected from the plurality of hardware and software thermal profiles. The set of software thermal profiles and the set of hardware thermal profiles are used to generate a thermal index. Finally, the execution of the set of applications is scheduled using the thermal index.

摘要翻译： 提供计算机实现的方法，数据处理系统和计算机可用代码，以使用软件和硬件热分布来调度应用程序的执行。 为一组处理器和一组应用程序分别生成硬件和软件热分布，以形成多个硬件和软件热分布。 然后从多个硬件和软件热分布中选择一组硬件和软件热分布。 软件热分布集和硬件热分布集合用于产生热指数。 最后，使用热指数调度该组应用程序的执行。

公开(公告)号：US20070043926A1

公开(公告)日：2007-02-22

申请号：US11208376

申请日：2005-08-19

申请人： Adam Burns ,  Michael Day ,  Brian Flachs ,  H. Hofstee ,  Charles Johns ,  John Liberty

发明人： Adam Burns ,  Michael Day ,  Brian Flachs ,  H. Hofstee ,  Charles Johns ,  John Liberty

IPC分类号： G06F12/00

CPC分类号： G06F12/0661 ,  G06F12/0223

摘要： A system and method for limiting the size of a local storage of a processor are provided. A facility is provided in association with a processor for setting a local storage size limit. This facility is a privileged facility and can only be accessed by the operating system running on a control processor in the multiprocessor system or the associated processor itself. The operating system sets the value stored in the local storage limit register when the operating system initializes a context switch in the processor. When the processor accesses the local storage using a request address, the local storage address corresponding to the request address is compared against the local storage limit size value in order to determine if the local storage address, or a modulo of the local storage address, is used to access the local storage.

摘要翻译： 提供了用于限制处理器的本地存储器的大小的系统和方法。 与用于设置本地存储大小限制的处理器相关联地提供设施。 该设施是一种特权设施，只能由在多处理器系统或相关处理器本身的控制处理器上运行的操作系统访问。 当操作系统初始化处理器中的上下文切换时，操作系统设置存储在本地存储限制寄存器中的值。 当处理器使用请求地址访问本地存储器时，将与请求地址相对应的本地存储地址与本地存储限制大小值进行比较，以便确定本地存储地址或本地存储地址的模数是否为 用于访问本地存储。

公开(公告)号：US20060190614A1

公开(公告)日：2006-08-24

申请号：US11065537

申请日：2005-02-24

申请人： Erik Altman ,  Peter Capek ,  Michael Gschwind ,  Charles Johns ,  Harm Hofstee ,  Martin Hopkins ,  James Kahle ,  Sumedh Sathaye ,  John-David Wellman

发明人： Erik Altman ,  Peter Capek ,  Michael Gschwind ,  Charles Johns ,  Harm Hofstee ,  Martin Hopkins ,  James Kahle ,  Sumedh Sathaye ,  John-David Wellman

IPC分类号： G06F15/16

CPC分类号： G06F9/4862 ,  G06F15/16 ,  H04L29/06027 ,  H04L63/168 ,  H04L67/10 ,  H04L67/34

摘要： A computer architecture and programming model for high speed processing over broadband networks are provided. The architecture employs a consistent modular structure, a common computing module and uniform software cells. The common computing module includes a control processor, a plurality of processing units, a plurality of local memories from which the processing units process programs, a direct memory access controller and a shared main memory. A synchronized system and method for the coordinated reading and writing of data to and from the shared main memory by the processing units also are provided. A hardware sandbox structure is provided for security against the corruption of data among the programs being processed by the processing units. The uniform software cells contain both data and applications and are structured for processing by any of the processors of the network. Each software cell is uniquely identified on the network.