一种图形化绝缘体上Si/NiSi2衬底材料及其制备方法

    公开(公告)号:CN103137538A

    公开(公告)日:2013-06-05

    申请号:CN201110383797.4

    申请日:2011-11-28

    Abstract: 本发明提供一种图形化绝缘体上Si/NiSi2衬底材料及其制备方法,通过抬离(lift-on)技术制作图形化的金属Ni层,通过对Ni与Si衬底进行退火反应生成NiSi2,并通过智能剥离工艺对其进行转移,以在传统SOI衬底的BOX层和顶层硅之间的部分区域插入一层金属硅化物NiSi2,以代替常规SOI双极晶体管中的集电区重掺杂埋层,未插入NiSi2的区域用以制造MOS器件,从而达到减小顶层硅厚度、简化工艺等目的。本发明的工艺简单,适用于大规模的工业生产。

    一种GaAsOI结构及Ⅲ-ⅤOI结构的制备方法

    公开(公告)号:CN103050432A

    公开(公告)日:2013-04-17

    申请号:CN201210559663.8

    申请日:2012-12-20

    Abstract: 本发明提供一种GaAsOI结构及Ⅲ-ⅤOI结构的制备方法,先通过外延技术和离子注入技术形成半导体衬底、GaAs层结构,所述半导体衬底中具有H离子或/及He离子注入层,且所述半导体衬底为Ge、Ge/Si、Ge/GeSi/Si或GOI衬底;于所述GaAs层表面形成第一SiO2层;键合一表面具有第二SiO2层的Si衬底,进行第一退火加强键合,进行第二退火使所述注入层剥离;采用XeF2气体腐蚀以去除GaAs层表面残留的半导体衬底,获得GaAsOI结构;采用类似的方案可以获得高质量的Ⅲ-ⅤOI结构。本发明通过分子束外延或超高真空化学气相沉积的手段,获得高质量的GaAs层及Ⅲ-Ⅴ半导体层;采用高选择性气体腐蚀的方法,可以有效地将通过智能剥离后的残留半导体衬底去除的同时保持GaAs层的完整性,从而有效地制备出高质量的GaAsOI或Ⅲ-ⅤOI。

    一种Ⅲ-ⅤOI结构的制备方法

    公开(公告)号:CN103021812A

    公开(公告)日:2013-04-03

    申请号:CN201210559716.6

    申请日:2012-12-20

    Abstract: 本发明提供一种Ⅲ-ⅤOI结构的制备方法,至少包括以下步骤:1)提供一半导体衬底,于所述半导体衬底表面形成GaAs层,于所述GaAs层表面形成Ⅲ-Ⅴ半导体层,于所述Ⅲ-Ⅴ半导体层表面形成第一SiO2层,所述半导体衬底为Ge、Ge/Si及Ge/GeSi/Si衬底的一种;2)提供一表面具有第二SiO2层的Si衬底,键合所述第一SiO2层及第二SiO2层;3)采用XeF2气体腐蚀以去除所述半导体衬底,获得GaAs层/Ⅲ-Ⅴ半导体层/SiO2层/Si衬底结构。本发明具有以下有益效果:通过分子束外延或超高真空化学气相沉积的手段可以获得高质量的Ⅲ-Ⅴ半导体层;通过高选择性气体腐蚀的方法制备Ⅲ-ⅤOI,可以有效地将半导体衬底去除的同时保持了Ⅲ-Ⅴ半导体层完整性,从而有效地制备出高质量的Ⅲ-ⅤOI。

    一种石墨烯的制备方法
    84.
    发明公开

    公开(公告)号:CN102874801A

    公开(公告)日:2013-01-16

    申请号:CN201210390882.8

    申请日:2012-10-15

    Abstract: 本发明提供一种石墨烯的制备方法,在氢气和惰性气氛下将半导体基底加热至810~910℃,保持该温度不变且通入碳源,采用化学气相沉积的方法在所述半导体基底表面进行反应,反应完毕后关闭碳源,并在氢气和惰性气氛下冷却至室温,完成在所述半导体基底表面制备石墨烯。相较于采用化学气相沉积在传统基底表面生长石墨烯而言,本发明直接在半导体材料表面合成制备石墨烯,简化了石墨烯制备工艺;同时,通过调节反应参数,可制备大尺寸、层数可控且无缺陷高质量石墨烯薄膜;另外,本发明与半导体工业相兼容,将能更快地推动石墨烯在半导体工业界的广泛应用。

    一种全隔离混合晶向SOI的制备方法

    公开(公告)号:CN102790004A

    公开(公告)日:2012-11-21

    申请号:CN201110125558.9

    申请日:2011-05-16

    Abstract: 本发明公开了一种全隔离混合晶向SOI衬底的制备方法,以及基于该方法的CMOS集成电路制备方法。本发明提出的全隔离混合晶向SOI衬底制备方法,采用SiGe层作为第一晶向外延的虚拟衬底层,从而可以形成第一晶向的顶层应变硅;采用多晶硅支撑材料作为连接第一晶向的顶层应变硅与第二晶向的顶层硅的支撑,从而可去除第一晶向顶层应变硅下方的SiGe层,填充绝缘材料形成绝缘埋层。该方法形成的顶层硅和绝缘埋层厚度均匀、可控,窗口内形成的应变硅与窗口外的顶层硅具有不同晶向,可分别为NMOS及PMOS提供更高的迁移率,从而提升了CMOS集成电路的性能。

    一种降低Si表面粗糙度的方法

    公开(公告)号:CN102751184A

    公开(公告)日:2012-10-24

    申请号:CN201210254007.7

    申请日:2012-07-20

    Abstract: 本发明提供一种降低Si表面粗糙度的方法,属于半导体领域,包括步骤:首先提供一至少包括SixGe1-x层以及结合于其表面的Si层的层叠结构,采用选择性腐蚀或机械化学抛光法去除所述SixGe1-x层,获得具有残留SixGe1-x材料的Si层粗糙表面,然后采用质量比为1∶3~6∶10~20的NH4OH:H2O2:H2O溶液对所述Si层粗糙表面进行处理,去除所述残留SixGe1-x材料,以获得光洁的Si层表面。本发明可以有效降低去除应变硅表面的SixGe1-x材料残余,降低应变硅表面的粗糙度,获得光洁的应变硅表面,为后续的器件制造工艺带来了极大的便利。本发明工艺简单,适用于工业生产。

    一种CMOS器件及其制作方法
    88.
    发明公开

    公开(公告)号:CN102664166A

    公开(公告)日:2012-09-12

    申请号:CN201210175119.3

    申请日:2012-05-31

    Abstract: 本发明提供一种CMOS器件及其制作方法,于具有SiO2层的Si衬底中分别形成第一深度的第一凹槽及大于所述第一深度的第二深度的第二凹槽,于所述第一凹槽及第二凹槽内分别形成Ge层、止刻层以及Ⅲ-Ⅴ族半导体层,然后采用选择性腐蚀技术刻蚀上述结构至所述第一凹槽内的Ge层,并使所述Ge层、SiO2层及Ⅲ-Ⅴ族半导体层处于同一平面,最后在所述Ge层上制作PMOS器件,在所述Ⅲ-Ⅴ族半导体层上制作NMOS器件以完成所述CMOS器件的制作。本发明只需在外延后通过选择性腐蚀工艺及抛光工艺即可获得具有Ge层及Ⅲ-Ⅴ族半导体层混合材料沟道的衬底,工艺简单,有利于降低成本;在该衬底上制备CMOS器件,具有较高的工作速度,有利于提高器件的性能。

    一种制备石墨烯的方法
    89.
    发明公开

    公开(公告)号:CN102627274A

    公开(公告)日:2012-08-08

    申请号:CN201210120753.7

    申请日:2012-04-23

    CPC classification number: C23C16/26 B82Y30/00 B82Y40/00 C01B32/186 C01B32/188

    Abstract: 本发明属于无机化合物技术领域,尤其涉及一种以CBr4为源材料利用分子束外延(MBE)或者化学气相沉淀(CVD)等方法直接制备石墨烯的方法。一种制备石墨烯的方法,包括如下步骤:选取适当的材料作为衬底;在衬底表面直接沉积催化剂和CBr4;对沉积所得的样品进行退火处理。相比于其他技术,本发明方法的创新点是可以定量可控地在任意基底上沉积催化剂和CBr4源,催化剂和CBr4源在基底表面发生反应而形成石墨烯。这样可以极大限度地减弱石墨烯生长对基底材料的依赖性,人们可以根据不同的应用背景选择不同的基底材料。

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