積體電路結構 INTEGRATED CIRCUIT STRUCTURE
    2.
    发明专利
    積體電路結構 INTEGRATED CIRCUIT STRUCTURE 审中-公开
    集成电路结构 INTEGRATED CIRCUIT STRUCTURE

    公开(公告)号:TW201103116A

    公开(公告)日:2011-01-16

    申请号:TW099122111

    申请日:2010-07-06

    IPC: H01L

    Abstract: 本發明揭示一種積體電路結構,包括:一晶片,包括一基底;以及一電源分配網絡。電源分配網絡包括:複數個電源矽通孔電極,穿過基底,其中電源矽通孔電極構成一柵網;以及複數個金屬線,位於一底層金屬化層(M1)中,其中金屬線將電源矽通孔電極耦接至位於基底上的積體電路裝置。

    Abstract in simplified Chinese: 本发明揭示一种集成电路结构,包括:一芯片,包括一基底;以及一电源分配网络。电源分配网络包括:复数个电源硅通孔电极,穿过基底,其中电源硅通孔电极构成一栅网;以及复数个金属线,位于一底层金属化层(M1)中,其中金属线将电源硅通孔电极耦接至位于基底上的集成电路设备。

    積體電路 INTEGRATED CIRCUIT
    4.
    发明专利
    積體電路 INTEGRATED CIRCUIT 审中-公开
    集成电路 INTEGRATED CIRCUIT

    公开(公告)号:TW201021160A

    公开(公告)日:2010-06-01

    申请号:TW098109688

    申请日:2009-03-25

    IPC: H01L

    CPC classification number: H01L27/0207 H01L21/823418 H01L21/823481

    Abstract: 本發明提供一種積體電路。上述積體電路包括一主動區域於一半導體基板中;一第一場效電晶體(FET)設置於該主動區域中;以及一隔離結構設置於該主動區域中。上述場效電晶體(FET)包括一第一閘極;一第一源極形成於該主動區域中,且設置於一第一區域上,鄰接該第一閘極;以及一第一汲極形成於該主動區域中,且設置於一第二區域上,鄰接該閘極。上述隔離結構包括一隔離閘極設置於鄰接該第一汲極;以及一隔離源極形成於該主動區域中,且設置於鄰接該隔離閘極使得該隔離源極和該第一汲極位於該隔離閘極的不同邊處。

    Abstract in simplified Chinese: 本发明提供一种集成电路。上述集成电路包括一主动区域于一半导体基板中;一第一场效应管(FET)设置于该主动区域中;以及一隔离结构设置于该主动区域中。上述场效应管(FET)包括一第一闸极;一第一源极形成于该主动区域中,且设置于一第一区域上,邻接该第一闸极;以及一第一汲极形成于该主动区域中,且设置于一第二区域上,邻接该闸极。上述隔离结构包括一隔离闸极设置于邻接该第一汲极;以及一隔离源极形成于该主动区域中,且设置于邻接该隔离闸极使得该隔离源极和该第一汲极位于该隔离闸极的不同边处。

    適應性電壓偏壓控制系統及積體電路 ADAPTIVE VOLTAGE BIAS CONTROL SYSTEM AND INTEGRATED CIRCUIT
    8.
    发明专利
    適應性電壓偏壓控制系統及積體電路 ADAPTIVE VOLTAGE BIAS CONTROL SYSTEM AND INTEGRATED CIRCUIT 审中-公开
    适应性电压偏压控制系统及集成电路 ADAPTIVE VOLTAGE BIAS CONTROL SYSTEM AND INTEGRATED CIRCUIT

    公开(公告)号:TW201013389A

    公开(公告)日:2010-04-01

    申请号:TW098128477

    申请日:2009-08-25

    IPC: G06F H03K

    CPC classification number: H03K19/0013

    Abstract: 本發明提供一積體電路。該積體電路包括一頻率偵側器耦接一邏輯電路;一供應電壓調節器耦接該頻率偵側器,用以依照自該頻率偵側器來的一頻率錯誤而提供一適應性電壓供應至該邏輯電路;以及一基體偏壓調節器耦接該頻率偵側器,用以依照該頻率錯誤而提供一適應性體偏壓至該邏輯電路。

    Abstract in simplified Chinese: 本发明提供一集成电路。该集成电路包括一频率侦侧器耦接一逻辑电路;一供应电压调节器耦接该频率侦侧器,用以依照自该频率侦侧器来的一频率错误而提供一适应性电压供应至该逻辑电路;以及一基体偏压调节器耦接该频率侦侧器,用以依照该频率错误而提供一适应性体偏压至该逻辑电路。

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