一种超结终端耐压器件
    1.
    发明公开

    公开(公告)号:CN116207129A

    公开(公告)日:2023-06-02

    申请号:CN202310306813.2

    申请日:2023-03-27

    IPC分类号: H01L29/06

    摘要: 本申请提供一种超结终端耐压器件,包括:有源区和漂移区,其中所述漂移区包括角终端和边终端;有源区等效PN主结区,设置于所述有源区和所述漂移区之间;多个杂质电荷补偿柱,每个所述杂质电荷补偿柱的全部或部分由所述有源区等效PN主结区向所述漂移区的角终端倾斜或折线延伸,各所述杂质电荷补偿柱相互平行且间隔设置。本申请通过在漂移区设置倾斜向角终端的杂质电荷补偿柱,可有效改善有源区边缘等效主PN结边界曲率效应,结构简单,更便于工艺制作,可降低制作成本。

    一种单粒子效应敏感区域确定方法及系统

    公开(公告)号:CN116029184A

    公开(公告)日:2023-04-28

    申请号:CN202310166000.8

    申请日:2023-02-23

    IPC分类号: G06F30/25 G06F111/10

    摘要: 本发明提供一种单粒子效应敏感区域确定方法及系统,该方法包括:利用重离子微束对待测半导体器件进行逐点扫描,根据逐点扫描结果绘制单粒子效应敏感区域平面图;再基于单粒子效应敏感区域平面图计算单粒子效应敏感区域的表面积,同时获取预先或实时基于待测半导体器件构建的三维数值仿真模型,并基于三维数值仿真模型确定出单粒子效应敏感区域的深度;最后将单粒子效应敏感区域的表面积和深度进行结合,得到待测半导体器件的单粒子效应敏感区域。由此可知,本发明可以确定出待测半导体的单粒子效应敏感区域表面积和深度。本发明通过数值仿真方法缓解了重离子实验机时短缺、费用昂贵的问题,大幅提高实验效率,节约了实验成本。

    一种深槽半导体光探测结构及其制造方法

    公开(公告)号:CN110212044B

    公开(公告)日:2021-07-20

    申请号:CN201910513109.8

    申请日:2019-06-13

    摘要: 本发明公开了一种深槽半导体光探测结构及其制造方法,其中,所述深槽半导体光探测结构包括半导体材料,所述半导体材料为第一导电杂质类型,在所述半导体材料的上表面向下开设欧姆接触掺杂区和多个深槽,所述欧姆接触掺杂区为具有第一导电杂质类型的掺杂区,所述深槽向其槽壁外扩散形成具有第二导电杂质类型的深槽扩散区,深槽扩散区在半导体材料里形成PN结,所述深槽位置形成具有第二导电杂质类型的深槽填充区,所述深槽填充区和深槽扩散区作为光探测电极A,欧姆接触掺杂区作为光探测电极B,本发明可以避免使用价格较贵且不易获得的极低掺杂的高阻半导体材料,并大幅度降低光探测反向偏置电压,降低相关偏置电压电路复杂度和难度。

    一种半导体元胞结构和功率半导体器件

    公开(公告)号:CN105529369B

    公开(公告)日:2019-05-14

    申请号:CN201610131447.1

    申请日:2016-03-08

    IPC分类号: H01L29/861 H01L29/40

    摘要: 本发明提供一种半导体元胞结构和功率半导体器件,其中,该半导体元胞结构包括有高掺杂半导体材料区,外延层,介质绝缘层,半绝缘材料,有源器件区,在所述外延层上还刻蚀有一深槽,所述深槽垂直进入到高掺杂半导体材料区里,于所述深槽内的侧壁上形成有介质绝缘层,且于所述深槽内填有半绝缘材料,半绝缘层顶部电极,在实际应用中可以将上述元胞以结构应用到功率半导体器件中,本发明大大降低了工艺实施难度,放宽了电荷平衡严酷的要求,容忍的电荷失配百分比大致放宽了10倍,同时也提高了器件元胞正常工作的长期可靠性,同时该技术方案结构也相对简单,相同可实施工艺条件下,保持了已有技术方案的主要性能。

    硅锗异质结双极晶体管发射极的制作方法

    公开(公告)号:CN108615682A

    公开(公告)日:2018-10-02

    申请号:CN201810477302.6

    申请日:2018-05-18

    IPC分类号: H01L21/331 H01L21/027

    摘要: 本发明公开一种硅锗异质结双极晶体管发射极的制作方法,包括:在衬底表面形成SiGe HBT晶体管基区窗口;在衬底的表面上形成SiGe材料层;在衬底的表面上形成SiGe HBT晶体管发射区窗口;在硅片表面上形成SiGe HBT晶体管多晶发射极;以及形成SiGe HBT晶体管。上述发明通过在第二多晶硅层上增加一层抗反射材料层,减小基区窗口底部和发射极周边台阶侧壁对多晶发射极光刻的反射,从而改善多晶发射极的形貌。同时该抗反射材料层还可以作为第三多晶硅层刻蚀时的停止层,可精确控制第二多晶硅层刻蚀,避免在后续刻蚀中损伤SiGe HBT的外基区材料层。

    一种带载流子寿命调节区的功率MOSFET器件及其制造方法

    公开(公告)号:CN107946360A

    公开(公告)日:2018-04-20

    申请号:CN201710301648.6

    申请日:2017-05-02

    摘要: 本发明公开了一种带载流子寿命调节区的功率MOSFET器件及其制造方法,其技术特征在于:包括漏极金属层、重掺杂第一导电类型衬底材料、轻掺杂第一导电类型第一外延层、重掺杂第一导电类型载流子寿命调节区、轻掺杂第一导电类型第二外延层、第二导电类型阱区、重掺杂第一导电类型源区、栅介质层、多晶硅栅介质层、ILD介质层、接触金属层、金属层和钝化介质层。重掺杂第一导电类型载流子寿命调节区位于颈区之下,可以复合很大一部分重粒子辐射产生的电子-空穴对,降低栅氧化层中的峰值电场;具有实现简单、导通电阻低、抗SEGR能力强的优点,可以用于抗辐射加固功率VDMOS器件的设计及制造领域。