公开(公告)号：US09201415B2

公开(公告)日：2015-12-01

申请号：US13341682

申请日：2011-12-30

申请人： Yong Ju Kim ,  Dae Han Kwon ,  Hae Rang Choi ,  Jae Min Jang

发明人： Yong Ju Kim ,  Dae Han Kwon ,  Hae Rang Choi ,  Jae Min Jang

IPC分类号： H03K19/00 ,  G05B19/042

CPC分类号： G05B19/042 ,  G05B2219/23314 ,  G05B2219/24036 ,  G05B2219/24037

摘要： An internal control signal regulation circuit includes a programming test unit configured to detect an internal control signal in response to an external control signal and generate a selection signal, test codes and a programming enable signal; and a code processing unit configured to receive the test codes or programming codes in response to the selection signal and regulate the internal control signal.

摘要翻译： 内部控制信号调节电路包括：编程测试单元，被配置为响应于外部控制信号检测内部控制信号，并产生选择信号，测试代码和编程使能信号; 以及代码处理单元，被配置为响应于所述选择信号接收所述测试代码或编程代码并调节所述内部控制信号。

公开(公告)号：US20090045862A1

公开(公告)日：2009-02-19

申请号：US12167066

申请日：2008-07-02

申请人： Yong Ju Kim ,  Kun Woo Park ,  Dae Han Kwon ,  Hee Woong Song ,  Ic Su Oh ,  Hyung Soo Kim ,  Tae Jin Hwang ,  Hae Rang Choi ,  Ji Wang Lee

发明人： Yong Ju Kim ,  Kun Woo Park ,  Dae Han Kwon ,  Hee Woong Song ,  Ic Su Oh ,  Hyung Soo Kim ,  Tae Jin Hwang ,  Hae Rang Choi ,  Ji Wang Lee

IPC分类号： H03K4/00

CPC分类号： H03K5/151

摘要： A clock generating circuit of a semiconductor memory apparatus includes a phase splitter that delays a clock to generate a delayed clock and inverts the clock to generate an inverted clock, and a clock buffer that buffers the delayed clock and the inverted clock and outputs a rising clock and a falling clock.

摘要翻译： 半导体存储装置的时钟产生电路包括：相位分离器，其延迟时钟以产生延迟的时钟并使时钟反相以产生反相时钟;以及时钟缓冲器，缓冲延迟时钟和反相时钟，并输出上升时钟 和一个下降的时钟。

公开(公告)号：US07208973B2

公开(公告)日：2007-04-24

申请号：US11008043

申请日：2004-12-09

申请人： Dae Han Kwon

发明人： Dae Han Kwon

IPC分类号： H03K17/16 ,  H03K5/12 ,  H03K19/094

CPC分类号： H04L25/0278

摘要： The present invention discloses an on die termination circuit. The on die termination circuit used in a DDR2 employs transmission gates as pull-up and pull-down switches, equalizes pull-up and pull-down resistance values by changing connection relations between switches and resistors, and maintains a constant voltage of an input pin.

摘要翻译： 本发明公开了一种片上终端电路。 DDR2中使用的裸片终端电路使用传输门作为上拉和下拉开关，通过改变开关和电阻之间的连接关系来平衡上拉和下拉电阻值，并保持输入引脚的恒定电压 。

公开(公告)号：US20090180338A1

公开(公告)日：2009-07-16

申请号：US12400956

申请日：2009-03-10

申请人： Dae Han Kwon

发明人： Dae Han Kwon

IPC分类号： G11C7/00 ,  G11C8/00

CPC分类号： G11C7/1051 ,  G11C7/1012 ,  G11C7/1045 ,  G11C7/106 ,  G11C7/1066 ,  G11C2207/108

摘要： The data output circuit for a semiconductor memory apparatus includes a first control signal generating unit configured to generate a first control signal according to a row address and a read command; and a data selecting unit configured to select data from a data line corresponding to a presently selected unit data output mode among data lines according to the first control signal or a second control signal, and output the data.

摘要翻译： 半导体存储装置的数据输出电路包括：第一控制信号生成部，其根据行地址和读取命令生成第一控制信号; 以及数据选择单元，被配置为根据第一控制信号或第二控制信号从数据线中的与当前选择的单位数据输出模式相对应的数据线选择数据，并输出数据。

公开(公告)号：US08378726B2

公开(公告)日：2013-02-19

申请号：US12846669

申请日：2010-07-29

申请人： Yong Ju Kim ,  Dae Han Kwon ,  Won Joo Yun ,  Hae Rang Choi ,  Jae Min Jang

发明人： Yong Ju Kim ,  Dae Han Kwon ,  Won Joo Yun ,  Hae Rang Choi ,  Jae Min Jang

IPC分类号： H03K5/04

CPC分类号： H03K5/1565

摘要： A clock signal duty correction circuit includes: a first transition timing control unit configured to generate a first control signal for controlling a rising timing of a duty correction clock signal by using a clock signal; a second transition timing control unit configured to generate a second control signal for varying a falling timing of the duty correction clock signal by using the clock signal according to a code signal; and a differential buffer unit configured to generate the duty correction clock signal, whose rising time or falling time is adjusted, in response to the first control signal and the second control signal.

摘要翻译： 时钟信号占空比校正电路包括：第一转移定时控制单元，被配置为通过使用时钟信号产生用于控制占空比校正时钟信号的上升定时的第一控制信号; 第二转移定时控制单元，被配置为通过使用根据代码信号的时钟信号来生成用于改变占空比校正时钟信号的下降定时的第二控制信号; 以及差分缓冲器单元，被配置为响应于所述第一控制信号和所述第二控制信号而生成其上升时间或下降时间被调整的占空比校正时钟信号。

公开(公告)号：US07715254B2

公开(公告)日：2010-05-11

申请号：US12400956

申请日：2009-03-10

申请人： Dae Han Kwon

发明人： Dae Han Kwon

IPC分类号： G11C7/00

CPC分类号： G11C7/1051 ,  G11C7/1012 ,  G11C7/1045 ,  G11C7/106 ,  G11C7/1066 ,  G11C2207/108

摘要： The data output circuit for a semiconductor memory apparatus includes a first control signal generating unit configured to generate a first control signal according to a row address and a read command; and a data selecting unit configured to select data from a data line corresponding to a presently selected unit data output mode among data lines according to the first control signal or a second control signal, and output the data.

摘要翻译： 半导体存储装置的数据输出电路包括：第一控制信号生成部，其根据行地址和读取命令生成第一控制信号; 以及数据选择单元，被配置为根据第一控制信号或第二控制信号从数据线中的与当前选择的单位数据输出模式相对应的数据线选择数据，并输出数据。

公开(公告)号：US20080012646A1

公开(公告)日：2008-01-17

申请号：US11647480

申请日：2006-12-29

申请人： Dae Han Kwon

发明人： Dae Han Kwon

IPC分类号： H03L7/00

CPC分类号： H03L7/07 ,  G11C7/22 ,  G11C7/222 ,  G11C11/4076

摘要： A semiconductor memory apparatus includes a PLL selector that selectively activates a plurality of PLL enable signals by decoding pluralities of PLL selection signals, and a plurality of PLL circuits that connect to a plurality of PLL enable signals respectively, wherein when the one of a plurality of PLL enable signals is activated, the PLL circuit connected the activated PLL enable signal is operated to execute phase locking operations.

摘要翻译： 半导体存储装置包括：PLL选择器，其通过解码多个PLL选择信号来选择性地激活多个PLL使能信号;以及多个PLL电路，分别连接到多个PLL使能信号，其中当多个 PLL使能信号被激活，连接激活的PLL使能信号的PLL电路被操作以执行相位锁定操作。

公开(公告)号：US08836370B2

公开(公告)日：2014-09-16

申请号：US13611298

申请日：2012-09-12

申请人： Ki Han Kim ,  Hyun Woo Lee ,  Dae Han Kwon ,  Chul Woo Kim ,  Soo Bin Lim

发明人： Ki Han Kim ,  Hyun Woo Lee ,  Dae Han Kwon ,  Chul Woo Kim ,  Soo Bin Lim

IPC分类号： H03K19/0175

CPC分类号： H03K19/094 ,  H03K19/0013 ,  H03K19/09482

摘要： A semiconductor apparatus includes a power supply changing unit. The power supply changing unit is configured to receive an enable signal and power supply voltage, generate first voltage or second voltage according to the enable signal, change a voltage level of the second voltage according to a level signal, and supply the first voltage or the second voltage as a driving voltage of an internal circuit, wherein the internal circuit receives a first input signal to output a second input signal.

摘要翻译： 一种半导体装置，包括电源改变单元。 电源改变单元被配置为接收使能信号和电源电压，根据使能信号产生第一电压或第二电压，根据电平信号改变第二电压的电压电平，并且提供第一电压或 第二电压作为内部电路的驱动电压，其中内部电路接收第一输入信号以输出第二输入信号。

公开(公告)号：US08471602B2

公开(公告)日：2013-06-25

申请号：US12983164

申请日：2010-12-31

申请人： Jun Woo Lee ,  Dae Han Kwon ,  Taek Sang Song

发明人： Jun Woo Lee ,  Dae Han Kwon ,  Taek Sang Song

IPC分类号： H03B1/00 ,  H03K3/00

CPC分类号： H03K19/018528

摘要： An output driver includes: a pull-up signal generation unit configured to control a pulse width of first data and output a pull-up pre-drive signal; a pull-down signal generation unit configured to control a pulse width of second data and output a pull-down pre-drive signal; a pull-up pre-driver unit configured to receive the pull-up pre-drive signal and generate a pull-up main drive signal; a pull-down pre-driver unit configured to receive the pull-down pre-drive signal and generate a pull-down main drive signal; a pull-up main driver unit configured to charge an output node according to the pull-up main drive signal; and a pull-down main driver unit configured to discharge the output node according to the pull-down main drive signal.

摘要翻译： 输出驱动器包括：上拉信号生成单元，被配置为控制第一数据的脉冲宽度并输出上拉预驱动信号; 下拉信号生成单元，被配置为控制第二数据的脉冲宽度并输出下拉预驱动信号; 上拉预驱动器单元，被配置为接收所述上拉预驱动信号并产生上拉主驱动信号; 配置成接收下拉预驱动信号并产生下拉主驱动信号的下拉预驱动器单元; 上拉主驱动器单元，被配置为根据上拉主驱动信号对输出节点进行充电; 以及配置成根据下拉主驱动信号对输出节点进行放电的下拉主驱动器单元。

公开(公告)号：US07512823B2

公开(公告)日：2009-03-31

申请号：US11109270

申请日：2005-04-19

申请人： Dae Han Kwon

发明人： Dae Han Kwon

IPC分类号： G06F1/26

CPC分类号： G11C5/147

摘要： Disclosed is a semiconductor device capable of detecting levels of an external supply voltage, which includes a plurality of signal receivers for simultaneously receiving external input signals, wherein a driving voltage is applied to only one of the signal receivers according to the levels of the external supply voltage.

摘要翻译： 公开了能够检测外部电源电压的水平的半导体器件，其包括用于同时接收外部输入信号的多个信号接收器，其中驱动电压仅根据外部电源的电平被施加到信号接收器中的一个 电压。