公开(公告)号：US07141765B2

公开(公告)日：2006-11-28

申请号：US10473248

申请日：2002-03-20

申请人： Toshiyuki Makiya ,  Takanori Saito ,  Karuki Eickmann ,  Sanjeev Kaushal ,  Anthony Dip ,  David L. O'meara

发明人： Toshiyuki Makiya ,  Takanori Saito ,  Karuki Eickmann ,  Sanjeev Kaushal ,  Anthony Dip ,  David L. O'meara

IPC分类号： H05B1/02 ,  A21B1/00

CPC分类号： G01K7/04 ,  G01K1/20

摘要： A antireflective film 50 is formed on a thermocouple 42 arranged in a processing vessel 1 of a heat treatment apparatus in order to improve the transient response characteristics of the thermocouple 42. In a typical embodiment, the thermocouple 42 is made by connecting a platinum wire 43A and a platinum-rhodium alloy wire 43B, and the antireflective film 50 is composed by stacking a silicon nitride layer 50C, silicon layer 50B and a silicon nitride layer 50A in that order.

摘要翻译： 为了改善热电偶42的瞬态响应特性，在设置在热处理装置的处理容器1中的热电偶42上形成防反射膜50。 在一个典型的实施例中，热电偶42是通过连接铂线43A和铂 - 铑合金线43B制成的，并且抗反射膜50由叠氮化硅层50C，硅层50B和硅 氮化物层50A。

公开(公告)号：US07737051B2

公开(公告)日：2010-06-15

申请号：US10797876

申请日：2004-03-10

申请人： Anthony Dip ,  Pradip K. Roy ,  Sanjeev Kaushal ,  Allen J. Leith ,  Seungho Oh ,  Raymond Joe

发明人： Anthony Dip ,  Pradip K. Roy ,  Sanjeev Kaushal ,  Allen J. Leith ,  Seungho Oh ,  Raymond Joe

IPC分类号： H01L21/36

CPC分类号： H01L21/31604 ,  H01L21/02142 ,  H01L21/0217 ,  H01L21/02175 ,  H01L21/02318 ,  H01L21/02323 ,  H01L21/02337 ,  H01L21/02362 ,  H01L21/31637 ,  H01L21/31641 ,  H01L21/31645 ,  H01L21/3185 ,  Y10T29/41

摘要： A method for using a silicon germanium (SiGe) surface layer to integrate a high-k dielectric layer into a semiconductor device. The method forms a SiGe surface layer on a substrate and deposits a high-k dielectric layer on the SiGe surface layer. An oxide layer, located between the high-k dielectric layer and an unreacted portion of the SiGe surface layer, is formed during one or both of deposition of the high-k dielectric layer and an annealing process after deposition of the high-k dielectric layer. The method further includes forming an electrode layer on the high-k dielectric layer.

摘要翻译： 一种使用硅锗（SiGe）表面层将高k电介质层集成到半导体器件中的方法。 该方法在衬底上形成SiGe表面层，并在SiGe表面层上沉积高k电介质层。 在高k电介质层的沉积和沉积高k电介质层之间的退火工艺中的一个或两个期间，形成位于高k电介质层和SiGe表面层的未反应部分之间的氧化物层 。 该方法还包括在高k电介质层上形成电极层。

公开(公告)号：US07165011B1

公开(公告)日：2007-01-16

申请号：US11217230

申请日：2005-09-01

申请人： Sanjeev Kaushal ,  Pradeep Pandey ,  Kenji Sugishima ,  Anthony Dip ,  David Smith ,  Raymond Joe ,  Sundar Gandhi

发明人： Sanjeev Kaushal ,  Pradeep Pandey ,  Kenji Sugishima ,  Anthony Dip ,  David Smith ,  Raymond Joe ,  Sundar Gandhi

IPC分类号： G06F11/30 ,  G06F15/00

CPC分类号： H01L22/10 ,  G05B23/0254 ,  H01L21/67248

摘要： A method of monitoring a thermal processing system in real-time using a built-in self test (BIST) table that includes positioning a plurality of wafers in a processing chamber in the thermal processing system; executing a real-time dynamic model to generate a predicted dynamic process response for the processing chamber during the processing time; creating a first measured dynamic process response; determining a dynamic estimation error using a difference between the predicted dynamic process response and the measured dynamic process response; and comparing the dynamic estimation error to operational thresholds established by one or more rules in the BIST table.

摘要翻译： 一种使用内置自检（BIST）表实时监测热处理系统的方法，其包括将多个晶片定位在热处理系统中的处理室中; 执行实时动态模型以在处理时间期间为处理室生成预测的动态过程响应; 创建第一个测量动态过程响应; 使用预测的动态过程响应和测量的动态过程响应之间的差来确定动态估计误差; 以及将动态估计误差与由BIST表中的一个或多个规则建立的操作阈值进行比较。

公开(公告)号：US20050199877A1

公开(公告)日：2005-09-15

申请号：US10797876

申请日：2004-03-10

申请人： Anthony Dip ,  Pradip Roy ,  Sanjeev Kaushal ,  Allen Leith ,  Seungho Oh ,  Raymond Joe

发明人： Anthony Dip ,  Pradip Roy ,  Sanjeev Kaushal ,  Allen Leith ,  Seungho Oh ,  Raymond Joe

IPC分类号： H01L21/28 ,  H01L21/316 ,  H01L21/318 ,  H01L29/51 ,  H01L29/12 ,  H01L21/36 ,  H01L21/3205

CPC分类号： H01L21/31604 ,  H01L21/02142 ,  H01L21/0217 ,  H01L21/02175 ,  H01L21/02318 ,  H01L21/02323 ,  H01L21/02337 ,  H01L21/02362 ,  H01L21/31637 ,  H01L21/31641 ,  H01L21/31645 ,  H01L21/3185 ,  Y10T29/41

摘要： A method for using a silicon germanium (SiGe) surface layer to integrate a high-k dielectric layer into a semiconductor device. The method forms a SiGe surface layer on a substrate and deposits a high-k dielectric layer on the SiGe surface layer. An oxide layer, located between the high-k dielectric layer and an unreacted portion of the SiGe surface layer, is formed during one or both of deposition of the high-k dielectric layer and an annealing process after deposition of the high-k dielectric layer. The method further includes forming an electrode layer on the high-k dielectric layer.

摘要翻译： 一种使用硅锗（SiGe）表面层将高k电介质层集成到半导体器件中的方法。 该方法在衬底上形成SiGe表面层，并在SiGe表面层上沉积高k电介质层。 在高k电介质层的沉积和沉积高k电介质层之间的退火工艺中的一个或两个期间，形成位于高k电介质层和SiGe表面层的未反应部分之间的氧化物层 。 该方法还包括在高k电介质层上形成电极层。

公开(公告)号：US07235440B2

公开(公告)日：2007-06-26

申请号：US10630969

申请日：2003-07-31

申请人： David L O'Meara ,  Cory Wajda ,  Anthony Dip ,  Michael Toeller ,  Toshihara Furukawa ,  Kristen Scheer ,  Alessandro Callegari ,  Fred Buehrer ,  Sufi Zafar ,  Evgeni Gousev ,  Anthony Chou ,  Paul Higgins

发明人： David L O'Meara ,  Cory Wajda ,  Anthony Dip ,  Michael Toeller ,  Toshihara Furukawa ,  Kristen Scheer ,  Alessandro Callegari ,  Fred Buehrer ,  Sufi Zafar ,  Evgeni Gousev ,  Anthony Chou ,  Paul Higgins

IPC分类号： H01L21/8242

CPC分类号： H01L21/28194 ,  H01L21/02238 ,  H01L21/02255 ,  H01L21/28167 ,  H01L21/28202 ,  H01L21/28211 ,  H01L21/3144 ,  H01L21/31604 ,  H01L21/31616 ,  H01L21/31637 ,  H01L21/31641 ,  H01L21/31645 ,  H01L21/31662 ,  H01L29/513 ,  H01L29/517 ,  H01L29/518

摘要： Ultra-thin oxide layers are formed utilizing low pressure processing to achieve self-limiting oxidation of substrates and provide ultra-thin oxide. The substrates to be processed can contain an initial dielectric layer such as an oxide layer, an oxynitride layer, a nitride layer, a high-k layer, or alternatively can lack an initial dielectric layer. The processing can be carried out using a batch type process chamber or, alternatively, using a single-wafer process chamber. One embodiment of the invention provides self-limiting oxidation of Si-substrates that results in SiO2 layers with a thickness of about 15 A, where the thickness of the SiO2 layers varies less than about 1 A over the substrates.

摘要翻译： 使用低压处理形成超薄氧化层，以实现衬底的自限制氧化并提供超薄氧化物。 待处理的基板可以包含初始介电层，例如氧化物层，氧氮化物层，氮化物层，高k层，或者可以缺少初始介电层。 处理可以使用间歇式处理室进行，或者使用单晶圆处理室进行。 本发明的一个实施例提供了Si衬底的自限制氧化，其导致厚度为约15A的SiO 2层，其中SiO 2层的厚度 在基材上变化小于约1A。

公开(公告)号：US20110241085A1

公开(公告)日：2011-10-06

申请号：US12751891

申请日：2010-03-31

申请人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A. Conti

发明人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A. Conti

IPC分类号： H01L29/78 ,  H01L21/311

CPC分类号： H01L29/4983 ,  H01L29/665 ,  H01L29/6656 ,  H01L29/6659 ,  H01L29/7833

摘要： A semiconducting device with a dual sidewall spacer and method of forming are provided. The method includes: depositing a first spacer layer over a patterned structure, the first spacer layer having a seam propagating through a thickness of the first spacer layer near an interface region of a surface of the substrate and a sidewall of the patterned structure, etching the first spacer layer to form a residual spacer at the interface region, where the residual spacer coats less than the entirety of the sidewall of the patterned structure, depositing a second spacer layer on the residual spacer and on the sidewall of the patterned structure not coated by the residual spacer, the second spacer layer being seam-free on the seam of the residual spacer, and etching the second spacer layer to form a second spacer coating the residual spacer and coating the sidewall of the patterned structure not coated by the residual spacer.

摘要翻译： 提供了具有双侧壁间隔件和成形方法的半导体器件。 该方法包括：在图案化结构上沉积第一间隔层，第一间隔层具有在衬底的表面的界面区附近传播穿过第一间隔层的厚度的接缝和图案化结构的侧壁，蚀刻 第一间隔层，以在界面区域处形成残留间隔物，其中残余间隔物涂覆小于图案化结构的侧壁的整体，在剩余间隔物上和在图案化结构的侧壁上沉积第二间隔层， 所述剩余间隔物，所述第二间隔层在所述残余间隔物的接缝上是无缝的，并且蚀刻所述第二间隔层以形成涂覆所述剩余间隔物并涂覆未被所述残留间隔物涂覆的所述图案化结构的侧壁的第二间隔物。

公开(公告)号：US07202186B2

公开(公告)日：2007-04-10

申请号：US10630970

申请日：2003-07-31

申请人： David L O'Meara ,  Cory Wajda ,  Anthony Dip ,  Michael Toeller ,  Toshihara Furukawa ,  Kristen Scheer ,  Alessandro Callegari ,  Fred Buehrer ,  Sufi Zafar ,  Evgeni Gousev ,  Anthony Chou ,  Paul Higgins

发明人： David L O'Meara ,  Cory Wajda ,  Anthony Dip ,  Michael Toeller ,  Toshihara Furukawa ,  Kristen Scheer ,  Alessandro Callegari ,  Fred Buehrer ,  Sufi Zafar ,  Evgeni Gousev ,  Anthony Chou ,  Paul Higgins

IPC分类号： H01L21/31 ,  H01L21/469

CPC分类号： H01L21/28185 ,  C23C16/308 ,  H01L21/0214 ,  H01L21/02238 ,  H01L21/02249 ,  H01L21/02255 ,  H01L21/28202 ,  H01L21/3144 ,  H01L21/31604 ,  H01L21/31616 ,  H01L21/31637 ,  H01L21/31641 ,  H01L21/31645 ,  H01L21/31662 ,  H01L21/67098 ,  H01L29/513 ,  H01L29/517 ,  H01L29/518

摘要： Ultra-thin oxynitride layers are formed utilizing low-pressure processing to achieve self-limiting oxidation of substrates and provide ultra-thin oxynitride. The substrates to be processed can contain an initial dielectric layer such as an oxide layer, an oxynitride layer, or a nitride layer, or alternatively can lack an initial dielectric layer. The processing can be carried out using a batch type process chamber or a single-wafer process chamber.

摘要翻译： 使用低压处理形成超薄氧氮化物层，以实现衬底的自限制氧化并提供超薄氧氮化物。 要处理的基板可以包含初始介电层，例如氧化物层，氧氮化物层或氮化物层，或者可以缺少初始介电层。 处理可以使用间歇式处理室或单晶片处理室进行。

公开(公告)号：US08673725B2

公开(公告)日：2014-03-18

申请号：US12751926

申请日：2010-03-31

申请人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A Conti

发明人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A Conti

IPC分类号： H01L29/78

CPC分类号： H01L21/28247 ,  H01L29/6656

摘要： A semiconducting device with a multilayer sidewall spacer and method of forming are described. In one embodiment, the method includes providing a substrate containing a patterned structure on a surface of the substrate and depositing a first spacer layer over the patterned structure at a first substrate temperature, where the first spacer layer contains a first material. The method further includes depositing a second spacer layer over the patterned substrate at a second substrate temperature that is different from the first substrate temperature, where the first and second materials contain the same chemical elements, and the depositing steps are performed in any order. The first and second spacer layers are then etched to form the multilayer sidewall spacer on the patterned structure.

摘要翻译： 描述了具有多层侧壁间隔件和形成方法的半导体器件。 在一个实施例中，该方法包括在衬底的表面上提供含有图案化结构的衬底，并且在第一衬底温度下在第一衬底温度下沉积在图案化结构上的第一间隔层，其中第一间隔层包含第一材料。 该方法还包括在不同于第一衬底温度的第二衬底温度下在图案化衬底上沉积第二间隔层，其中第一和第二材料含有相同的化学元素，并且沉积步骤以任何顺序进行。 然后蚀刻第一和第二间隔层以在图案化结构上形成多层侧壁间隔物。

公开(公告)号：US08664102B2

公开(公告)日：2014-03-04

申请号：US12751891

申请日：2010-03-31

申请人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A Conti

发明人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A Conti

IPC分类号： H01L21/3205 ,  H01L21/4763

CPC分类号： H01L29/4983 ,  H01L29/665 ,  H01L29/6656 ,  H01L29/6659 ,  H01L29/7833

摘要： A semiconducting device with a dual sidewall spacer and method of forming are provided. The method includes: depositing a first spacer layer over a patterned structure, the first spacer layer having a seam propagating through a thickness of the first spacer layer near an interface region of a surface of the substrate and a sidewall of the patterned structure, etching the first spacer layer to form a residual spacer at the interface region, where the residual spacer coats less than the entirety of the sidewall of the patterned structure, depositing a second spacer layer on the residual spacer and on the sidewall of the patterned structure not coated by the residual spacer, the second spacer layer being seam-free on the seam of the residual spacer, and etching the second spacer layer to form a second spacer coating the residual spacer and coating the sidewall of the patterned structure not coated by the residual spacer.

摘要翻译： 提供了具有双侧壁间隔件和成形方法的半导体器件。 该方法包括：在图案化结构上沉积第一间隔层，第一间隔层具有在衬底的表面的界面区附近传播穿过第一间隔层的厚度的接缝和图案化结构的侧壁，蚀刻 第一间隔层，以在界面区域处形成残留间隔物，其中残余间隔物涂覆小于图案化结构的侧壁的整体，在剩余间隔物上和在图案化结构的侧壁上沉积第二间隔层， 所述剩余间隔物，所述第二间隔层在所述残余间隔物的接缝上是无缝的，并且蚀刻所述第二间隔层以形成涂覆所述剩余间隔物并涂覆未被所述残留间隔物涂覆的所述图案化结构的侧壁的第二间隔物。

公开(公告)号：US20110241128A1

公开(公告)日：2011-10-06

申请号：US12751926

申请日：2010-03-31

申请人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A. Conti

发明人： David L. O'Meara ,  Anthony Dip ,  Aelan Mosden ,  Pao-Hwa Chou ,  Richard A. Conti

IPC分类号： H01L29/78 ,  H01L21/336

CPC分类号： H01L21/28247 ,  H01L29/6656

摘要： A semiconducting device with a multilayer sidewall spacer and method of forming are described. In one embodiment, the method includes providing a substrate containing a patterned structure on a surface of the substrate and depositing a first spacer layer over the patterned structure at a first substrate temperature, where the first spacer layer contains a first material. The method further includes depositing a second spacer layer over the patterned substrate at a second substrate temperature that is different from the first substrate temperature, where the first and second materials contain the same chemical elements, and the depositing steps are performed in any order. The first and second spacer layers are then etched to form the multilayer sidewall spacer on the patterned structure.

摘要翻译： 描述了具有多层侧壁间隔件和形成方法的半导体器件。 在一个实施例中，该方法包括在衬底的表面上提供含有图案化结构的衬底，并且在第一衬底温度下在第一衬底温度下沉积在图案化结构上的第一间隔层，其中第一间隔层包含第一材料。 该方法还包括在不同于第一衬底温度的第二衬底温度下在图案化衬底上沉积第二间隔层，其中第一和第二材料含有相同的化学元素，并且沉积步骤以任何顺序进行。 然后蚀刻第一和第二间隔层以在图案化结构上形成多层侧壁间隔物。