公开(公告)号：US08803241B2

公开(公告)日：2014-08-12

申请号：US13538734

申请日：2012-06-29

申请人： Jr-Jung Lin ,  Chih-Han Lin ,  Ming-Ching Chang

发明人： Jr-Jung Lin ,  Chih-Han Lin ,  Ming-Ching Chang

IPC分类号： H01L21/70

CPC分类号： H01L29/66795 ,  H01L21/30604 ,  H01L21/823431 ,  H01L29/42372 ,  H01L29/66545 ,  H01L29/6681

摘要： The disclosure relates to a dummy gate electrode of a semiconductor device. An embodiment comprises a substrate comprising a first surface; an insulation region covering a portion of the first surface, wherein the top of the insulation region defines a second surface; and a dummy gate electrode over the second surface, wherein the dummy gate electrode comprises a bottom and a base broader than the bottom, wherein a ratio of a width of the bottom to a width of the base is from about 0.5 to about 0.9.

摘要翻译： 本公开涉及半导体器件的虚拟栅电极。 一个实施例包括一个包括第一表面的基底; 覆盖所述第一表面的一部分的绝缘区域，其中所述绝缘区域的顶部限定第二表面; 以及在所述第二表面上的虚拟栅电极，其中所述虚拟栅电极包括底部和比所述底部宽的底部，其中所述底部的宽度与所述基部的宽度的比率为约0.5至约0.9。

公开(公告)号：US08258588B2

公开(公告)日：2012-09-04

申请号：US12757241

申请日：2010-04-09

申请人： Yu Chao Lin ,  Jr Jung Lin ,  Yih-Ann Lin ,  Jih-Jse Lin ,  Chao-Cheng Chen ,  Ryan Chia-Jen Chen ,  Weng Chang

发明人： Yu Chao Lin ,  Jr Jung Lin ,  Yih-Ann Lin ,  Jih-Jse Lin ,  Chao-Cheng Chen ,  Ryan Chia-Jen Chen ,  Weng Chang

IPC分类号： H01L29/78 ,  H01L21/8234 ,  H01L21/8238

CPC分类号： H01L29/4983 ,  H01L29/6656

摘要： An exemplary structure for a gate structure of a field effect transistor comprises a gate electrode; a gate insulator under the gate electrode having footing regions on opposing sides of the gate electrode; and a sealing layer on sidewalls of the gate structure, wherein a thickness of lower portion of the sealing layer overlying the footing regions is less than a thickness of upper portion of the sealing layer on sidewalls of the gate electrode, whereby the field effect transistor made has almost no recess in the substrate surface.

摘要翻译： 场效应晶体管的栅极结构的示例性结构包括栅电极; 栅电极下方的栅极绝缘体，在栅电极的相对侧具有基极区域; 以及在所述栅极结构的侧壁上的密封层，其中覆盖所述基底区域的所述密封层的下部的厚度小于所述栅极电极的侧壁上的所述密封层的上部的厚度，由此所述场效应晶体管 在基板表面几乎没有凹陷。

公开(公告)号：US20120164822A1

公开(公告)日：2012-06-28

申请号：US13408016

申请日：2012-02-29

申请人： Yih-Ann Lin ,  Ryan Chia-Jen Chen ,  Chien-Hao Chen ,  Kuo-Tai Huang ,  Yi-Hsing Chen ,  Jr Jung Lin

发明人： Yih-Ann Lin ,  Ryan Chia-Jen Chen ,  Chien-Hao Chen ,  Kuo-Tai Huang ,  Yi-Hsing Chen ,  Jr Jung Lin

IPC分类号： H01L21/28

CPC分类号： H01L21/823828 ,  H01L21/3221 ,  H01L29/4966 ,  H01L29/513 ,  H01L29/517

摘要： Methods of fabricating semiconductor devices with high-k/metal gate features are disclosed. In some instances, methods of fabricating semiconductor devices with high-k/metal gate features are disclosed that prevent or reduce high-k/metal gate contamination of non-high-k/metal gate wafers and production tools. In some embodiments, the method comprises forming an interfacial layer over a semiconductor substrate on a front side of the substrate; forming a high-k dielectric layer and a capping layer over the interfacial layer; forming a metal layer over the high-k and capping layers; forming a polysilicon layer over the metal layer; and forming a dielectric layer over the semiconductor substrate on a back side of the substrate.

摘要翻译： 公开了制造具有高k /金属栅极特征的半导体器件的方法。 在一些情况下，公开了制造具有高k /金属栅极特征的半导体器件的方法，其防止或减少非高k /金属栅极晶片和生产工具的高k /金属栅极污染。 在一些实施例中，该方法包括在衬底的前侧上的半导体衬底上形成界面层; 在界面层上形成高k电介质层和覆盖层; 在高k和覆盖层上形成金属层; 在所述金属层上形成多晶硅层; 以及在所述衬底的背面上在所述半导体衬底上形成介电层。

公开(公告)号：US08163625B2

公开(公告)日：2012-04-24

申请号：US12753972

申请日：2010-04-05

申请人： Yih-Ann Lin ,  Hao-Ming Lien ,  Ryan Chia-Jen Chen ,  Jr Jung Lin ,  Yu Chao Lin ,  Chih-Han Lin

发明人： Yih-Ann Lin ,  Hao-Ming Lien ,  Ryan Chia-Jen Chen ,  Jr Jung Lin ,  Yu Chao Lin ,  Chih-Han Lin

IPC分类号： H01L21/76

CPC分类号： H01L21/76232

摘要： The disclosure relates to integrated circuit fabrication, and more particularly to an electronic device with an isolation structure having almost no divot. An exemplary method for fabricating an isolation structure, comprising: forming a pad oxide layer over a top surface of a substrate; forming an opening in the pad oxide layer, exposing a portion of the substrate; etching the exposed portion of the substrate, forming a trench in the substrate; filling the trench with an insulator; exposing a surface of the pad oxide layer and a surface of the insulator to a vapor mixture including at least an NH3 and a fluorine-containing compound; and heating the substrate at a temperature between 100° C. to 200° C.

摘要翻译： 本公开涉及集成电路制造，并且更具体地涉及具有几乎没有纹波的隔离结构的电子器件。 一种用于制造隔离结构的示例性方法，包括：在衬底的顶表面上形成衬垫氧化物层; 在所述衬垫氧化物层中形成开口，暴露所述衬底的一部分; 蚀刻衬底的暴露部分，在衬底中形成沟槽; 用绝缘体填充沟槽; 将衬垫氧化物层的表面和绝缘体的表面暴露于至少包含NH 3和含氟化合物的蒸汽混合物; 并在100℃至200℃的温度下加热基材。

公开(公告)号：US20100041223A1

公开(公告)日：2010-02-18

申请号：US12478509

申请日：2009-06-04

申请人： Ryan Chia-Jen Chen ,  Yih-Ann Lin ,  Jr Jung Lin ,  Yi-Shien Mor ,  Chien-Hao Chen ,  Kuo-Tai Huang ,  Yi-Hsing Chen

发明人： Ryan Chia-Jen Chen ,  Yih-Ann Lin ,  Jr Jung Lin ,  Yi-Shien Mor ,  Chien-Hao Chen ,  Kuo-Tai Huang ,  Yi-Hsing Chen

IPC分类号： H01L21/28

CPC分类号： H01L21/82385 ,  H01L21/28088 ,  H01L21/823842 ,  H01L21/823857 ,  H01L27/0922 ,  H01L29/0653 ,  H01L29/401 ,  H01L29/42372 ,  H01L29/4966 ,  H01L29/517

摘要： The present disclosure provides a method of fabricating a semiconductor device. The method includes providing a semiconductor substrate having a first active region and a second active region, forming a high-k dielectric layer over the semiconductor substrate, forming a first metal layer over the high-k dielectric layer, the first metal layer having a first work function, removing a portion of the first metal layer in the second active region, thereafter, forming a semiconductor layer over the first metal layer in the first active region and over the partially removed first metal layer in the second active region, forming a first gate stack in the first active region and a second gate stack in the second active region, removing the semiconductor layer from the first gate stack and from the second gate stack, and forming a second metal layer on the first metal layer in the first gate stack and on the partially removed first metal layer in the second gate stack, the second metal layer having a second work function.

摘要翻译： 本公开提供了制造半导体器件的方法。 该方法包括提供具有第一有源区和第二有源区的半导体衬底，在半导体衬底上形成高k电介质层，在高k电介质层上形成第一金属层，第一金属层具有第一 在第二有源区中除去第一金属层的一部分，然后在第一有源区中的第一金属层上方和在第二有源区中的部分去除的第一金属层上方形成半导体层，形成第一 在第一有源区中的栅极堆叠和第二有源区中的第二栅极堆叠，从第一栅极堆叠和第二栅极堆叠中去除半导体层，以及在第一栅极堆叠中的第一金属层上形成第二金属层 并且在第二栅极堆叠中部分去除的第一金属层上，第二金属层具有第二功函数。

公开(公告)号：US08911559B2

公开(公告)日：2014-12-16

申请号：US12463243

申请日：2009-05-08

申请人： Yu Chao Lin ,  Ryan Chia-Jen Chen ,  Yih-Ann Lin ,  Jr Jung Lin

发明人： Yu Chao Lin ,  Ryan Chia-Jen Chen ,  Yih-Ann Lin ,  Jr Jung Lin

IPC分类号： B08B5/00 ,  B08B7/04 ,  H01J37/32

CPC分类号： H01J37/32862 ,  Y10S438/905

摘要： A method for cleaning an etching chamber is disclosed. The method comprises providing an etching chamber; introducing a first gas comprising an inert gas into the etching chamber for a first period of time; and transporting a first wafer into the etching chamber after the first period of time, wherein the first wafer undergoes an etching process.

摘要翻译： 公开了一种用于清洁蚀刻室的方法。 该方法包括提供蚀刻室; 将包含惰性气体的第一气体引入所述蚀刻室中第一时间段; 以及在所述第一时间段之后将第一晶片输送到所述蚀刻室中，其中所述第一晶片进行蚀刻处理。

公开(公告)号：US08574989B2

公开(公告)日：2013-11-05

申请号：US13314462

申请日：2011-12-08

申请人： Che-Cheng Chang ,  Po-Chi Wu ,  Buh-Kuan Fang ,  Jr-Jung Lin ,  Ryan Chia-Jen Chen

发明人： Che-Cheng Chang ,  Po-Chi Wu ,  Buh-Kuan Fang ,  Jr-Jung Lin ,  Ryan Chia-Jen Chen

IPC分类号： H01L21/336

CPC分类号： H01L21/28114 ,  H01L21/02071 ,  H01L21/32135 ,  H01L29/42376 ,  H01L29/66545 ,  H01L29/7843

摘要： The present application discloses a method of forming a semiconductor structure. In at least one embodiment, the method includes forming a polysilicon layer over a substrate. A mask layer is formed over the polysilicon layer. The mask layer is patterned to form a patterned mask layer. A polysilicon structure is formed by etching the polysilicon layer using the patterned mask layer as a mask. The polysilicon structure has an upper surface and a lower surface, and the etching of the polysilicon layer is arranged to cause a width of the upper surface of the polysilicon structure greater than that of the lower surface of the polysilicon structure.

摘要翻译： 本申请公开了一种形成半导体结构的方法。 在至少一个实施例中，该方法包括在衬底上形成多晶硅层。 在多晶硅层上形成掩模层。 图案化掩模层以形成图案化掩模层。 通过使用图案化掩模层作为掩模蚀刻多晶硅层来形成多晶硅结构。 多晶硅结构具有上表面和下表面，并且多晶硅层的蚀刻被布置成使得多晶硅结构的上表面的宽度大于多晶硅结构的下表面的宽度。

公开(公告)号：US20130252425A1

公开(公告)日：2013-09-26

申请号：US13428923

申请日：2012-03-23

申请人： Chih-Han LIN ,  Ming-Ching CHANG ,  Ryan Chia-Jen CHEN ,  Yih-Ann LIN ,  Jr-Jung LIN

发明人： Chih-Han LIN ,  Ming-Ching CHANG ,  Ryan Chia-Jen CHEN ,  Yih-Ann LIN ,  Jr-Jung LIN

IPC分类号： H01L21/3105 ,  H01L21/306

CPC分类号： H01L21/0337 ,  H01L21/0338 ,  H01L21/3086 ,  H01L21/3088 ,  H01L21/31144 ,  H01L21/76816

摘要： A method includes providing a first mask pattern over a substrate, forming first spacers adjoining sidewalls of the first mask pattern, removing the first mask pattern, forming second spacers adjoining sidewalls of the first spacers, forming a filling layer over the substrate and between the second spacers, and forming a second mask pattern over the substrate.

摘要翻译： 一种方法包括在衬底上提供第一掩模图案，形成与第一掩模图案的侧壁相邻的第一间隔物，去除第一掩模图案，形成邻接第一间隔物的侧壁的第二间隔物，在衬底上形成填充层， 并且在衬底上形成第二掩模图案。

公开(公告)号：US20130119487A1

公开(公告)日：2013-05-16

申请号：US13438451

申请日：2012-04-03

申请人： Jr Jung Lin ,  Yun-Ju Sun ,  Shih-Hsun Chang ,  Chia-Jen Chen ,  Tomonari Yamamoto ,  Chih-Wei Kuo ,  Meng-Yi Sun ,  Kuo-Chiang Ting

发明人： Jr Jung Lin ,  Yun-Ju Sun ,  Shih-Hsun Chang ,  Chia-Jen Chen ,  Tomonari Yamamoto ,  Chih-Wei Kuo ,  Meng-Yi Sun ,  Kuo-Chiang Ting

IPC分类号： H01L29/78 ,  H01L21/28

CPC分类号： H01L21/0206 ,  H01L21/02071 ,  H01L21/28088 ,  H01L21/28114 ,  H01L21/31116 ,  H01L21/31122 ,  H01L21/32136 ,  H01L21/32137 ,  H01L29/42376 ,  H01L29/513 ,  H01L29/517 ,  H01L29/66545 ,  H01L29/6659 ,  H01L29/7848

摘要： The present disclosure provides a semiconductor structure. The semiconductor structure includes a semiconductor substrate; and a gate stack disposed on the semiconductor substrate. The gate stack includes a high k dielectric material layer, a capping layer disposed on the high k dielectric material layer, and a metal layer disposed on the capping layer. The capping layer and the high k dielectric material layer have a footing structure.

摘要翻译： 本公开提供了一种半导体结构。 半导体结构包括半导体衬底; 以及设置在半导体衬底上的栅极堆叠。 栅极堆叠包括高k电介质材料层，设置在高k电介质材料层上的覆盖层和设置在覆盖层上的金属层。 覆盖层和高k电介质材料层具有基础结构。

公开(公告)号：US08383502B2

公开(公告)日：2013-02-26

申请号：US13186572

申请日：2011-07-20

申请人： Ryan Chia-Jen Chen ,  Yih-Ann Lin ,  Jr Jung Lin ,  Yi-Shien Mor ,  Chien-Hao Chen ,  Kuo-Tai Huang ,  Yi-Hsing Chen

发明人： Ryan Chia-Jen Chen ,  Yih-Ann Lin ,  Jr Jung Lin ,  Yi-Shien Mor ,  Chien-Hao Chen ,  Kuo-Tai Huang ,  Yi-Hsing Chen

IPC分类号： H01L21/3205 ,  H01L21/4763

CPC分类号： H01L21/82385 ,  H01L21/28088 ,  H01L21/823842 ,  H01L21/823857 ,  H01L27/0922 ,  H01L29/0653 ,  H01L29/401 ,  H01L29/42372 ,  H01L29/4966 ,  H01L29/517

摘要： A method of fabricating a semiconductor device includes providing a semiconductor substrate having a first active region and a second active region, forming a first metal layer over a high-k dielectric layer, removing at least a portion of the first metal layer in the second active region, forming a second metal layer on first metal layer in the first active region and over the high-k dielectric layer in the second active region, and thereafter, forming a silicon layer over the second metal layer. The method further includes removing the silicon layer from the first gate stack thereby forming a first trench and from the second gate stack thereby forming a second trench, and forming a third metal layer over the second metal layer in the first trench and over the second metal layer in the second trench.

摘要翻译： 制造半导体器件的方法包括提供具有第一有源区和第二有源区的半导体衬底，在高k电介质层上形成第一金属层，去除第二有源区中的第一金属层的至少一部分 在第一有源区的第一金属层上形成第二金属层，在第二有源区的高k电介质层上形成第二金属层，然后在第二金属层上形成硅层。 该方法还包括从第一栅极堆叠中去除硅层，从而形成第一沟槽并从第二栅极堆叠形成第二沟槽，并且在第一沟槽中的第二金属层上方形成第三金属层，并在第二金属 在第二沟槽中。